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基于FPGA實(shí)現(xiàn)FOC算法之Clark模塊設(shè)計(jì)

FPGA研究院 ? 來源:FPGA之旅 ? 2025-08-27 09:21 ? 次閱讀
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一. 簡介

今天給大家講解的是FOC流程中的Clark變換,在流程圖中的位置如下圖所示。

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二. 變換需要

無刷電機(jī)在運(yùn)行的過程中,三相電流是一個幅值頻率相等、相位相差120°的正弦波,由于相位是固定的,那么可以輕松通過投影的手段,將三相電流變?yōu)閮上嚯娏鳎凛S和β軸電流,也就是Clark變換,這樣在分析問題時,三個變量就簡化成為了兩個變量。

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變換公式推導(dǎo)出來,并且化簡后,如下圖所示,這樣就只需要在FPGA中將其實(shí)現(xiàn)出來即可。

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三. FPGA實(shí)現(xiàn)細(xì)節(jié)

FPGA內(nèi)部一般是不直接處理小數(shù)的,而且通過將小數(shù)擴(kuò)大相應(yīng)的倍數(shù)然后取整進(jìn)行計(jì)算。在公式中有兩個常數(shù),將其擴(kuò)大2^16,然后取整的結(jié)果為18'd37937和18'd75674,這里要將常量指定為18bit位寬,因?yàn)樵?020中,DSP的計(jì)算乘法時的位寬為25bitx18bit。乘法的計(jì)算可以采用IP的方式,同樣也可以采用*直接運(yùn)算,為了便于移植,本設(shè)計(jì)直接采樣的*進(jìn)行運(yùn)算。

整個變換只涉及到兩個乘法和一次加法,還是比較容易實(shí)現(xiàn)的~,那我們就下期再見。

加減速模塊測試~~ 還需要進(jìn)一步優(yōu)化~~~

來源:本文轉(zhuǎn)載自FPGA之旅公眾號

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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原文標(biāo)題:FPGA從零到一實(shí)現(xiàn)FOC(二)之Clark模塊設(shè)計(jì)

文章出處:【微信號:FPGA研究院,微信公眾號:FPGA研究院】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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