資料介紹
本文討論了一種可在FPGA 上實(shí)現(xiàn)的FFT 結(jié)構(gòu)。該結(jié)構(gòu)采用基于流水線結(jié)構(gòu)和快速并行乘法器的蝶形處理器。乘法器采用改進(jìn)的Booth 算法,簡(jiǎn)化了部分積符號(hào)擴(kuò)展,使用Wallace 樹(shù)結(jié)構(gòu)和4-2 壓縮器對(duì)部分積歸約。以8 點(diǎn)復(fù)點(diǎn)FFT 為實(shí)例設(shè)計(jì)相應(yīng)的控制電路。使用VHDL 語(yǔ)言完成設(shè)計(jì),并綜合到FPGA 中。從綜合的結(jié)果看該結(jié)構(gòu)可在XC4025E-2 上以52MHz 的時(shí)鐘高速運(yùn)行。在此基礎(chǔ)上易于擴(kuò)展為大點(diǎn)數(shù)FFT 運(yùn)算結(jié)構(gòu)。
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