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在Xilinx的FPGA中，時(shí)鐘網(wǎng)絡(luò)資源分為兩大類：全局時(shí)鐘資源和區(qū)域時(shí)鐘資源。
全局時(shí)鐘資源是一種專用互連網(wǎng)絡(luò)，它可以降低時(shí)鐘歪斜、占空比失真和功耗，提高抖動容限。Xilinx的全局時(shí)鐘資源設(shè)計(jì)了專用時(shí)鐘緩沖與驅(qū)動結(jié)構(gòu)，從而使全局時(shí)鐘到達(dá)CLB、IOB和BRAM的延時(shí)最小。
區(qū)域時(shí)鐘資源是獨(dú)立于全局時(shí)鐘網(wǎng)絡(luò)的。Xilinx的器件分成若干個(gè)時(shí)鐘區(qū)域，以Virtex-6為例，Virtex-6的最小器件有6個(gè)區(qū)域，最大器件有18個(gè)區(qū)域。它與全局時(shí)鐘不同，區(qū)域時(shí)鐘信號X只能驅(qū)動限定的時(shí)鐘區(qū)域。
這里面提到區(qū)域時(shí)鐘的概念，需要解釋一下。Xilinx的FPGA器件是通過時(shí)鐘區(qū)域來管理時(shí)鐘網(wǎng)絡(luò)的，以Virtex-6為例，時(shí)鐘區(qū)域的大小固定為40個(gè)CLB 高，半個(gè)晶片寬。因此大尺寸的器件有更多的時(shí)鐘區(qū)域。如下圖所示，下圖中的FPGA器件一共包含6個(gè)時(shí)鐘區(qū)域，左側(cè)三個(gè)右側(cè)三個(gè)，從圖可以看出每個(gè)區(qū)域高度是2*20CLBs，區(qū)域?qū)挾仁前雮€(gè)FPGA芯片的寬度。中間是CMT時(shí)鐘管理模塊。
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