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      電子發(fā)燒友網(wǎng)>電子資料下載>電子論文>電源技術(shù)論文>便攜式微處理器內(nèi)核電源電壓的改進

      便攜式微處理器內(nèi)核電源電壓的改進

      2010-06-06 | rar | 422 | 次下載 | 5積分

      資料介紹

      當今的處理技術(shù)正向著更小型化發(fā)展，以減小諸如DSP和微處理器之類高密度邏輯器件的尺寸。CMOS結(jié)構(gòu)隨之采用了更小的溝道和更薄的柵極，因此擊穿電壓較低，從而要求更低的處理器內(nèi)核成電壓。本文將討論這些新技術(shù)如何對電源管理方法提出更新的要求，并為設(shè)計便攜產(chǎn)品遇到的獨特難題提供解決方案。
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