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時序

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這里所說的時序其實就是指時序圖，又名序列圖、循序圖、順序圖，是一種UML交互圖。它通過描述對象之間發(fā)送消息的時間順序顯示多個對象之間的動態(tài)協(xié)作。

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時序技術

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FPGA的幾點重要總結

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2018-12-01 標簽：fpga 硬件時序 4.4k 0

新Vivado報告命令的了解

了解report_design_analysis，這是一個新的Vivado報告命令，可以獨特地了解時序和復雜性特征，這些特性對于分析時序收斂問題很有價值。

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XDC約束及物理約束的介紹

觀看視頻，了解和學習有關XDC約束，包括時序，以及物理約束相關知識。

2019-01-07 標簽：賽靈思語言時序 7k 0

ug1292時序收斂快速參考手冊

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2018-10-09 標簽：時序代碼 3.8k 0

時序違例的修正與時序優(yōu)化的思考方向

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分析和預測時序數(shù)據(jù)的主要方法,如何使用Python處理時序數(shù)據(jù)

讓我們從一個樸素的假設開始——“明天會和今天一樣”，但是我們并不使用類似y^t=y(t-1)這樣的模型（這其實是一個適用于任意時序預測問題的很好的基線，...

2018-09-04 標簽：函數(shù)時序 Python 3.0萬 0

時序約束中一種特殊的情景分析

在做模塊級綜合的時候，對于IO路徑一般會使用60%的端口時鐘進行約束，如果這樣的路徑涉及到feedthrough path，也就是INPUT->REG的...

2018-08-21 標簽：電路時序 1.2萬 0

繞等長更快的操作方法

從早期的15.x版本到如今依然運用廣泛的16.5版本，不管是差分對內還是組間，繞等長的命令只有一個Delay Tune可以用，不過就這一個命令從速度上來...

2018-07-20 標簽：相位時序 5.4k 0

分享上海交通大學團隊在兩項競賽任務中的算法思路和方案

在時序動作定位問題中，mean Average Precision (mAP) 是最常用的評估指標。此次競賽計算0.5到0.95, 以0.05為步長的多...

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對比ARM、DSP，深入了解FPGA

自1985年首款FPGA誕生以來，F(xiàn)PGA已經(jīng)是一名在電子信息領域征戰(zhàn)了30年的老兵，這名戰(zhàn)功赫赫的老兵如今已經(jīng)正式開赴了一個新的戰(zhàn)場。但是FPGA并不...

2018-05-18 標簽：fpga 時序 6.8k 0

FPGA時序約束簡介

在簡單電路中，當頻率較低時，數(shù)字信號的邊沿時間可以忽略時，無需考慮時序約束。但在復雜電路中，為了減少系統(tǒng)中各部分延時，使系統(tǒng)協(xié)同工作，提高運行頻率，需要...

2018-03-30 標簽：FPGA 時序 1.5萬 0

時序分析基本概念介紹——花一樣的“模式”

SE是scan enable信號，它控制著scan cell的工作模式。從圖中可以看出，SE，SI，D端通過一個Mux實現(xiàn)工作模式的切換。當SE輸入為0...

2018-03-26 標簽：DFT 時序 1.5萬 0

ECO填充工具帶來不一樣的IC設計

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2018-06-07 標簽：ic設計時序 eco 8.5k 0

詳細分析高速通信和數(shù)據(jù)中心的時序要求以及時鐘振蕩器解決方案

為此，Silicon Labs提供了全新有源時鐘振蕩器，其采用第四代 DSPLL 技術驅動，有效解決了 25/40/50/100/400Gbps 時序問...

2018-01-26 標簽：數(shù)據(jù)中心時序時鐘振蕩器 8.5k 0

關于FPGA時序以及時序收斂的基本概念詳解

FPGA器件的需求取決于系統(tǒng)和上下游（upstream and downstrem）設備。我們的設計需要和其他的devices進行數(shù)據(jù)的交互，其他的d...

2018-07-11 標簽：FPGA 時序 9.9k 0

詳細介紹時序基本概念Timing arc

時序分析基本概念介紹——Timing Arc

2018-01-02 標簽：時序時序弧 2.5萬 0

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2017-12-25 標簽：時序 lcd1602 10k 0

做嵌入式系統(tǒng)開發(fā)，少不了數(shù)電模電的知識

做嵌入式系統(tǒng)開發(fā)，經(jīng)常要接觸硬件。做嵌入式開發(fā)對數(shù)字電路和模擬電路要有一定的了解。這樣才能深入的研究下去。下面我們簡單的介紹嵌入式開發(fā)中的一些硬件相關的知識。

2017-12-01 標簽：譯碼器嵌入式開發(fā)時序 1.5萬 0

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