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時序

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這里所說的時序其實(shí)就是指時序圖，又名序列圖、循序圖、順序圖，是一種UML交互圖。它通過描述對象之間發(fā)送消息的時間順序顯示多個對象之間的動態(tài)協(xié)作。

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時序技術(shù)

FPGA設(shè)計(jì)中經(jīng)常犯的10個錯誤

本文列出了FPGA設(shè)計(jì)中常見的十個錯誤。我們收集了 FPGA 工程師在其設(shè)計(jì)中犯的 10 個最常見錯誤，并提供了解決方案的建議和替代方案。本文假定讀者已...

2023-05-31 標(biāo)簽：fpga FPGA設(shè)計(jì)RTL 1.5k 1

DFX設(shè)計(jì)如何分析

針對DFX設(shè)計(jì)，Vivado提供了命令report_pr_configuration_analysis，該命令會從設(shè)計(jì)復(fù)雜度、時鐘和時序等方面對其進(jìn)行分...

2023-11-09 標(biāo)簽：fpga 命令時序 1.5k 0

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2014-08-15 標(biāo)簽：FPGA 時序 RTL代碼 1.4k 1

電源時序規(guī)格及控制框圖

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FPGA的數(shù)字信號處理：重寫FIR邏輯以滿足時序要求

在上一篇文章中（FPGA 的數(shù)字信號處理：Verilog 實(shí)現(xiàn)簡單的 FIR 濾波器）演示了在 Verilog 中編寫自定義 FIR 模塊的初始demo...

2023-06-09 標(biāo)簽：fpga 存儲器數(shù)字信號處理 1.4k 0

高扇出信號線優(yōu)化技巧（上）

高扇出信號線 (HFN) 是具有大量負(fù)載的信號線。作為用戶，您可能遇到過高扇出信號線相關(guān)問題，因?yàn)閷⑺胸?fù)載都連接到 HFN 的驅(qū)動程序需要使用大量布線...

2025-08-28 標(biāo)簽：負(fù)載寄存器信號線 1.4k 0

電源時序規(guī)格②：電路和常數(shù)計(jì)算示例

2023-12-05 標(biāo)簽：電源電路時序 1.3k 0

高扇出信號線優(yōu)化技巧（下）

該屬性會將每個驅(qū)動程序的扇出限制告知工具，并通過指示布局器了解扇出限制來指引該工具對高扇出的負(fù)載進(jìn)行分配。此屬性可同時應(yīng)用于 FF 與 LUT 驅(qū)動程序...

2025-08-28 標(biāo)簽：寄存器信號線時序 1.3k 0

FPGA設(shè)計(jì)的常用基本時序路徑分析

該條路徑包括了觸發(fā)器內(nèi)部clock-to-Q的延遲，觸發(fā)器之間的由組合邏輯造成的路徑延遲以及目標(biāo)觸發(fā)器的建立時間，其延時是數(shù)據(jù)從源觸發(fā)器開始，在下一個時...

2024-01-18 標(biāo)簽：fpga 觸發(fā)器時序 1.3k 0

DS1624 2-Wire通信SDA保持時間澄清

DS2的1624線時序規(guī)格與I2C不同。本應(yīng)用筆記詳細(xì)介紹了其中的區(qū)別。SDA不由DS1624內(nèi)部保持?？偩€主站有責(zé)任保持SDA，直到SCL的下降沿完成。

2023-02-08 標(biāo)簽：總線時序 I2C總線 1.2k 0

如何優(yōu)化FPGA設(shè)計(jì)的性能

優(yōu)化FPGA（現(xiàn)場可編程門陣列）設(shè)計(jì)的性能是一個復(fù)雜而多維的任務(wù)，涉及多個方面和步驟。以下是一些關(guān)鍵的優(yōu)化策略：一、明確性能指標(biāo) 確定需求：首先，需...

2024-10-25 標(biāo)簽：FPGA 存儲器時序 1.2k 0

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文件注釋：文件注釋就是一個說明文：這通常在文件的頭部注釋，用于描述代碼為那個工程中，由誰寫的，日期是多少，功能描述，有哪些子功能，及版本修改的標(biāo)示。這樣...

2019-01-26 標(biāo)簽：fpga 時序 1.2k 0

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自從 CubeMX 等圖像配置軟件的出現(xiàn)，同學(xué)們往往點(diǎn)幾下鼠標(biāo)就解決了單片機(jī)的配置問題。對于追求開發(fā)速度的業(yè)務(wù)場景下，使用快速配置軟件是合理的，高效的，...

2023-06-22 標(biāo)簽：STM32 軟件時序 1.2k 0

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靜態(tài)時序分析基礎(chǔ)與應(yīng)用連載（2）

除了Clock之外，對于電路其他輸出輸入端點(diǎn)及其周邊的環(huán)境（Boundary Condition）也要加以描述。

2017-02-11 標(biāo)簽：時序靜態(tài)時序 1.1k 0

詳解Prometheus的數(shù)據(jù)類型

對于 Prometheus 生態(tài)的監(jiān)控系統(tǒng)，PromQL 是必備技能，本文著重點(diǎn)講解這個查詢語言，摻雜一些生產(chǎn)實(shí)踐場景，希望對你有所幫助。

2025-05-13 標(biāo)簽：監(jiān)控系統(tǒng)時序數(shù)據(jù)類型 1.1k 0

Lesson38 圖像傳感器介紹與設(shè)計(jì)架構(gòu)

? 圖1 實(shí)驗(yàn)平臺視頻內(nèi)容： Lesson38 圖像傳感器介紹與設(shè)計(jì)架構(gòu)（本節(jié)視頻） ??? ● 介紹CCD與CMOS圖像傳感器 ??? ● 圖像傳感...

2023-05-22 標(biāo)簽：接口圖像傳感器時序 1.1k 0

RQS設(shè)計(jì)收斂建議ID RQS_CLOCK-12

本文聊聊“RQS_CLOCK-12”時鐘設(shè)置建議以及它如何幫助達(dá)成時序收斂

2023-07-12 標(biāo)簽：寄存器緩沖器時序 1.1k 0

靜態(tài)時序分析基礎(chǔ)與應(yīng)用連載（3）

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2017-02-11 標(biāo)簽：時序靜態(tài)時序 1.1k 0

時序邏輯程序中推斷組合邏輯？

使用always_ff和在靈敏度列表中指定一個時鐘邊沿并不意味著過程中的所有邏輯都是時序邏輯。綜合編譯器將推斷出每個被非阻塞賦值的變量的觸發(fā)器。阻塞賦值...

2023-02-20 標(biāo)簽：邏輯觸發(fā)器時序 1.1k 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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