asic

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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會，它是澳大利亞金融服務(wù)和市場的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

自動駕駛主流架構(gòu)方案對比：GPU、FPGA、ASIC

當(dāng)前主流的AI芯片主要分為三類，GPU、FPGA、ASIC。GPU、FPGA均是前期較為成熟的芯片架構(gòu)，屬于通用型芯片。ASIC屬于為AI特定場景定制的...

2023-02-14 標(biāo)簽：fpga asic gpu 4.3k 0

排序電路提供偽電壓跟蹤器

本應(yīng)用筆記介紹了三種跟蹤電源軌之間電壓的方法。特色電路也是最簡單的方法，采用MAX6819電源排序器，執(zhí)行開環(huán)電壓跟蹤。

2023-02-14 標(biāo)簽：微控制器電源 asic 1.1k 0

時(shí)序邏輯的時(shí)鐘到Q傳播和建立/保持時(shí)間

數(shù)字門級電路可分為兩大類：組合邏輯和時(shí)序邏輯。鎖存器是組合邏輯和時(shí)序邏輯的一個交叉點(diǎn)，在后面會作為單獨(dú)的主題處理。

2023-02-12 標(biāo)簽：fpga asic RTL 1.8k 0

通過無引腳MicroPak和有引腳PicoGate邏輯封裝實(shí)現(xiàn)邏輯器件微型化

微型邏輯器件封裝的尺寸只有傳統(tǒng)SO封裝的1/15，在空間受限的移動應(yīng)用中大幅縮小了占位面積，現(xiàn)在也可用于汽車應(yīng)用。

2023-02-10 標(biāo)簽：asic 逆變器邏輯器件 1.3k 0

什么是FPGA的綜合和約束的關(guān)系？

系統(tǒng)Verilog RTL模型-這些模型由設(shè)計(jì)工程師編寫，代表需要在ASIC或FPGA中實(shí)現(xiàn)的功能行為

2023-02-09 標(biāo)簽：fpga asic Verilog 1.8k 0

ASIC芯片分類介紹及特點(diǎn)分析

在硬件層面，ASIC 芯片由基本硅材料、磷化鎵、砷化鎵、氮化鎵等材料構(gòu)成。在物理結(jié)構(gòu)層面，ASIC 芯片模塊由外掛存儲單元、電源管理器、音頻畫面處理器、...

2023-02-08 標(biāo)簽：模擬電路 asic cpu 7.8k 0

寫Verilog，F(xiàn)PGA和ASIC如何選擇？

FPGA：Field（現(xiàn)場） Programmable（可編程） Gate（邏輯門） Array（陣列），F(xiàn)PGA是一種可以重構(gòu)電路的芯片，是一種硬件可...

2023-02-03 標(biāo)簽：fpga asic Verilog 770 0

AI/ML助力SoC驗(yàn)證按期完工

單顆芯片上集成的晶體管數(shù)量，已經(jīng)超過全球人口總數(shù)，且還在提升過程中。

2023-02-03 標(biāo)簽：asic EDA工具晶體管 1.1k 0

Matlab算法映射至FPGA硬件邏輯

引言：本文分享一篇技術(shù)PPT，該P(yáng)PT主要介紹如何將算法映射到FPGA或ASIC硬件架構(gòu)。

2023-01-30 標(biāo)簽：fpga matlab asic 2.8k 0

介紹一種ISE聯(lián)合仿真轉(zhuǎn)換為Moldelsim單獨(dú)仿真的方法

找到仿真頂層的tb文件，cut_through_top_tb。

2023-01-29 標(biāo)簽：FPGA設(shè)計(jì)asic ModelSim 2.3k 0

2MHz雙通道DC/DC控制器將負(fù)載釋放瞬建立時(shí)間減半

LTC3838 和 LTC3839 控制器專為滿足要求最苛刻的低輸出電壓、高負(fù)載電流應(yīng)用的需要而設(shè)計(jì)。兩者都具有卓越的差分調(diào)節(jié)精度和快速瞬態(tài)響應(yīng)。受控導(dǎo)...

2023-01-17 標(biāo)簽：處理器控制器 asic 1.4k 0

適用于Altera FPGA的電源解決方案

現(xiàn)場可編程門陣列（FPGA）用于各種應(yīng)用和終端市場，由于其出色的設(shè)計(jì)靈活性和低工程成本，它們已經(jīng)獲得了超過ASIC的市場份額。FPGA 的電源設(shè)計(jì)和管理...

2023-01-17 標(biāo)簽：電源 fpga asic 3.8k 0

使用絞線和其他常用電線來降低EMI/RFI

FPGA 為設(shè)計(jì)工程師的控制提供了相當(dāng)大的功能和靈活性。在定制專用集成電路（ASIC）中永遠(yuǎn)不可行的相對小批量的項(xiàng)目變得實(shí)用。許多大批量項(xiàng)目在致力于定制...

2023-01-17 標(biāo)簽：集成電路放大器 asic 1.6k 0

一文看懂DPDK技術(shù) Linux+x86網(wǎng)絡(luò)IO瓶頸分析

網(wǎng)卡從1G到100G的發(fā)展，CPU從單核到多核到多CPU的發(fā)展，服務(wù)器的單機(jī)能力通過橫行擴(kuò)展達(dá)到新的高點(diǎn)。

2023-01-13 標(biāo)簽：asic cpu DPDK 1.3k 0

變速驅(qū)動器中使用的集成電路的功能安全

IEC 61508-2：2010包含重要的IC要求，但在偶然或不完整的標(biāo)準(zhǔn)閱讀中很容易錯過。要求包括ASIC開發(fā)V模型，參見IEC 61508-2：20...

2023-01-06 標(biāo)簽：集成電路驅(qū)動器 asic 2.1k 0

避免FPGA、GPU和ASIC系統(tǒng)電源管理中的調(diào)試周期

在設(shè)計(jì)FPGA、GPU或ASIC控制系統(tǒng)時(shí)，與數(shù)字設(shè)計(jì)相關(guān)的電源管理和模擬系統(tǒng)相關(guān)的設(shè)計(jì)挑戰(zhàn)數(shù)量相形見絀。然而，假設(shè)電源系統(tǒng)設(shè)計(jì)可以留給“以后”或與數(shù)字...

2023-01-06 標(biāo)簽：fpga asic 電源管理 1.6k 0

從CPU到ASIC，架構(gòu)越來越碎片化

是超異構(gòu)計(jì)算架構(gòu)。CPU+GPU+FPGA+DSA等多種架構(gòu)處理引擎組成的超異構(gòu)計(jì)算；實(shí)現(xiàn)既要又要：接近CPU的靈活性，接近ASIC的性能效率，以及多個...

2023-01-05 標(biāo)簽：asic cpu gpu 2.6k 0

集成組件為超聲系統(tǒng)設(shè)計(jì)提供了靈活性

在當(dāng)今的超聲市場中，便攜性和性能是系統(tǒng)設(shè)計(jì)人員的關(guān)鍵指標(biāo)。便攜性突破了系統(tǒng)的界限，以滿足消費(fèi)者對“口袋”和便攜式復(fù)雜工具的需求，而性能需求決定了整個系統(tǒng)...

2023-01-04 標(biāo)簽：放大器 asic adc 996 0

利用FPGA的可編程能力以及相關(guān)的工具來準(zhǔn)確估算功耗

AMD-Xilinx在20nm & 16nm節(jié)點(diǎn)Ultrascale系列器件使用FinFET工藝，F(xiàn)inFET與Planar相比在相同速度條件下...

2022-12-29 標(biāo)簽：FPGA設(shè)計(jì)asic 晶體管 2.2k 0

計(jì)算架構(gòu)：從異構(gòu)到超異構(gòu)技術(shù)解讀

ISA（Instruction Set Architecture，指令集架構(gòu)），是計(jì)算機(jī)體系結(jié)構(gòu)與編程相關(guān)的部分（不包含組成和實(shí)現(xiàn)）。ISA定義了：指令...

2023-01-01 標(biāo)簽：asic cpu 4.6k 0

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時(shí)模擬信號的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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