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ASIC是Application Specific Integrated Circuit的英文縮寫，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

什么是FPGA，ASIC，如何設(shè)計(jì)一個(gè)適用于它們的供電系統(tǒng)

目前，在集成電路界ASIC被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。是指應(yīng)特定用戶要求和特定電子系統(tǒng)的需要而設(shè)計(jì)、制造的集成電路。ASIC的特點(diǎn)是面向特定...

2017-05-08 標(biāo)簽：電源 fpga asic 2k 0

正點(diǎn)原子開拓者FPGA視頻:開拓者FPGA開發(fā)板綜合測(cè)試

FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。

2019-09-18 標(biāo)簽：fpga asic 開發(fā)板 2k 0

利用Hi-Z緩沖器緩沖簡(jiǎn)化高性能模擬前端信號(hào)鏈設(shè)計(jì)

由于部署滿足系統(tǒng)要求的基于復(fù)合環(huán)路的電路非常復(fù)雜，工程師通常需要設(shè)計(jì)定制的應(yīng)用特定集成電路 (ASIC) 或使用多個(gè)分立式元件，如圖 1 所示。這兩種方...

2022-01-25 標(biāo)簽：電路 asic 緩沖器 2k 0

基于DSP+FPGA的紅外移動(dòng)目標(biāo)識(shí)別跟蹤系統(tǒng)設(shè)計(jì)

與通用集成電路相比，ASIC芯片具有體積小、重量輕、功耗低、可靠性高等幾個(gè)方面的優(yōu)勢(shì)，而且在大批量應(yīng)用時(shí)，可降低成本。##在本系統(tǒng)中，F(xiàn)PGA控制了絕大...

2014-08-14 標(biāo)簽：DSP FPGA ASIC 1.9k 0

把一個(gè)算法用RTL實(shí)現(xiàn)，有哪些比較科學(xué)的步驟？

通常來(lái)講，我們做算法實(shí)現(xiàn)，需要有對(duì)標(biāo)的算法模型，作為驗(yàn)證硬件邏輯設(shè)計(jì)是否正確的參考依據(jù)。

2023-03-22 標(biāo)簽：fpga 邏輯電路 asic 1.9k 0

應(yīng)用于LCoS微型顯示器的彩色時(shí)序控制器的電路設(shè)計(jì)

基于頭盔顯示器對(duì)便攜性的要求，要實(shí)現(xiàn)微型化和低功耗，將彩色時(shí)序控制器設(shè)計(jì)為單片的ASIC是較好的解決方案。本文正是針對(duì)應(yīng)用LCoS（Liquid Cry...

2020-04-25 標(biāo)簽：顯示器控制器 asic 1.9k 0

將基于圖形的物理綜合添加到FPGA的設(shè)計(jì)中

傳統(tǒng)的綜合技術(shù)越來(lái)越不能滿足當(dāng)今采用 90 納米及以下工藝節(jié)點(diǎn)實(shí)現(xiàn)的非常大且復(fù)雜的 FPGA 設(shè)計(jì)的需求了。問題是傳統(tǒng)的 FPGA 綜合引擎是基于源自 ...

2018-11-28 標(biāo)簽：fpga asic 引擎 1.9k 0

使用mailbox和MUTEX的處理器間通信解決方案

現(xiàn)在業(yè)界的許多解決方案都包含多個(gè)處理器，或者是硬核處理器，如Arm A9、A53或R5，軟核如MicroBlaze、Arm Cortex-M1/M3，或...

2023-09-21 標(biāo)簽：處理器 fpga arm 1.9k 0

數(shù)字電源管理可在改善系統(tǒng)性能的同時(shí)又可降低能源成本

本文探討了在網(wǎng)絡(luò)交換機(jī)和路由器、基站和服務(wù)器、以及工業(yè)和醫(yī)療設(shè)備中，怎樣通過(guò)使用 LTC2974 四通道數(shù)字電源管理 IC 來(lái)改善性能、可靠性和能效。

2013-04-01 標(biāo)簽：ASIC 數(shù)字電源 LTC2974 1.9k 0

UltraScale可編程架構(gòu)如何解決互連問題？

它不僅能解決整體系統(tǒng)吞吐量擴(kuò)展限制的問題和時(shí)延問題，而且直接應(yīng)對(duì)先進(jìn)節(jié)點(diǎn)芯片性能方面的最大瓶頸問題——互連。事實(shí)上，UltraScale架構(gòu)能夠從布線、...

2013-07-09 標(biāo)簽：FPGA ASIC 3dic 1.9k 0

專用集成電路簡(jiǎn)稱叫什么集成電路按功能可分為哪兩種

專用集成電路的簡(jiǎn)稱是ASIC，即Application Specific Integrated Circuit。集成電路（Integrated Cir...

2024-04-19 標(biāo)簽：放大器 asic 電子器件 1.9k 0

硬件仿真對(duì)網(wǎng)絡(luò)設(shè)計(jì)有何影響？

設(shè)計(jì)用于網(wǎng)絡(luò)應(yīng)用程序的ASIC面臨著獨(dú)特的挑戰(zhàn)。一是這些設(shè)備的帶寬和延遲性能測(cè)試需要比其他類型的IC所需的仿真周期大得多的仿真周期。當(dāng)然，擴(kuò)展的模擬會(huì)減...

2021-05-02 標(biāo)簽：fpga asic 仿真器 1.9k 0

淺談IC集成電路設(shè)計(jì)的物理設(shè)計(jì)

　　ASIC物理設(shè)計(jì)中的單元，集成電路設(shè)計(jì)中特殊的單元要求是盡量減少可能的CMOS問題。更多的不是比基本功能所必需的晶體管。　　*保護(hù)部件不受破壞 ...

2023-06-12 標(biāo)簽：集成電路 asic 晶體管 1.9k 0

SoC設(shè)計(jì)的IO PAD怎么移植到FPGA原型驗(yàn)證

FPGA原型驗(yàn)證系統(tǒng)要盡可能多的復(fù)用SoC相關(guān)的模塊，這樣才是復(fù)刻SoC原型的意義所在。

2023-04-19 標(biāo)簽：fpga asic SoC設(shè)計(jì) 1.8k 0

時(shí)序邏輯的時(shí)鐘到Q傳播和建立/保持時(shí)間

數(shù)字門級(jí)電路可分為兩大類：組合邏輯和時(shí)序邏輯。鎖存器是組合邏輯和時(shí)序邏輯的一個(gè)交叉點(diǎn)，在后面會(huì)作為單獨(dú)的主題處理。

2023-02-12 標(biāo)簽：fpga asic RTL 1.8k 0

專用集成電路技術(shù)是什么技術(shù) 通用和專用集成電路區(qū)別

專用集成電路技術(shù)（Application-Specific Integrated Circuit, ASIC）是一種電路設(shè)計(jì)和制造技術(shù)，用于滿足特定應(yīng)用...

2024-04-21 標(biāo)簽：asic 電子系統(tǒng)硬件 1.8k 0

用于下一代汽車專用集成電路（ASIC）的嵌入式現(xiàn)場(chǎng)可編程邏輯門陣列（eFPGA）

2020-07-24 標(biāo)簽：集成電路 asic gpu 1.8k 0

基于IP核的FPGA設(shè)計(jì)方法是什么？

幾年前設(shè)計(jì)專用集成電路（ASIC）還是少數(shù)集成電路設(shè)計(jì)工程師的事，隨著硅的集成度不斷提高，百萬(wàn)門的ASIC 已不難實(shí)現(xiàn)，系統(tǒng)制造公司的設(shè)計(jì)人員正越...

2023-10-11 標(biāo)簽：dsp fpga cpld 1.8k 0

如何理解嵌入式系統(tǒng)中的FPGA設(shè)計(jì)

與ASIC一樣，供應(yīng)商在FPGA設(shè)計(jì)中也需要應(yīng)對(duì)面積和速度的挑戰(zhàn)。隨著門數(shù)不斷增加，F(xiàn)PGA需要更大的面積和尺寸來(lái)適應(yīng)更多的應(yīng)用，設(shè)計(jì)工具需要采用更好的...

2018-07-02 標(biāo)簽：fpga 嵌入式 asic 1.8k 0

什么是FPGA的綜合和約束的關(guān)系？

系統(tǒng)Verilog RTL模型-這些模型由設(shè)計(jì)工程師編寫，代表需要在ASIC或FPGA中實(shí)現(xiàn)的功能行為

2023-02-09 標(biāo)簽：fpga asic Verilog 1.8k 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
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