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ASIC是Application Specific Integrated Circuit的英文縮寫(xiě)，在集成電路界被認(rèn)為是一種為專門目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫(xiě)，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

如何區(qū)分FPGA與ASIC

ASIC基本都是基于標(biāo)準(zhǔn)單元開(kāi)始設(shè)計(jì)的，還需要進(jìn)行Place & Route。當(dāng)芯片存在任何問(wèn)題時(shí)，必須再次重新投片，直到達(dá)到你想要的功能和性能...

2023-03-21 標(biāo)簽：fpga 芯片 asic 1.4k 0

淺談IO-Link、OPC UA、單對(duì)以太網(wǎng)的優(yōu)勢(shì)

通過(guò)讓現(xiàn)場(chǎng)設(shè)備和傳感器更智能，使其成為助力制造企業(yè)實(shí)施數(shù)字化轉(zhuǎn)型的關(guān)鍵要素。

2023-12-29 標(biāo)簽：傳感器以太網(wǎng)asic 1.4k 0

墨菲定律和設(shè)計(jì)“非數(shù)據(jù)手冊(cè)”的風(fēng)險(xiǎn)

本應(yīng)用筆記考慮了集成電路（IC）的數(shù)據(jù)手冊(cè)外工作。它討論了等待沒(méi)有經(jīng)歷過(guò)墨菲定律的工程師的陷阱，墨菲定律是任何可能出錯(cuò)的東西，都會(huì)在最糟糕的時(shí)候出錯(cuò)。本...

2023-06-10 標(biāo)簽：集成電路 asic 電位器 1.4k 0

專用集成電路是什么電路專用集成電路和通用有哪些不同

專用集成電路（Application Specific Integrated Circuit，ASIC）是根據(jù)特定應(yīng)用需求而設(shè)計(jì)和制造的集成電路。與通用...

2024-04-14 標(biāo)簽：集成電路 asic 專用集成電路 1.4k 0

專用集成電路和通用有哪些區(qū)別

專用集成電路（ASIC）和通用集成電路（ASIC）是兩種不同類型的集成電路，它們?cè)谠O(shè)計(jì)和用途上有很大的不同。以下是專用集成電路和通用集成電路之間的區(qū)別以...

2024-04-19 標(biāo)簽：asic 手機(jī)處理器專用集成電路 1.4k 0

為高性能ASIC和微處理器供電

當(dāng)今性能最高的ASIC和微處理器的功耗可能超過(guò)150W。當(dāng)電源電壓為1V至1.5V時(shí)，這些器件所需的電流很容易超過(guò)100A。通過(guò)使用多相DC-DC轉(zhuǎn)換器...

2023-03-02 標(biāo)簽：ASIC 微處理器 DC-DC 1.4k 0

如何在FPGA內(nèi)實(shí)現(xiàn)最佳化車用MCU設(shè)計(jì)方案？

下一代汽車電子系統(tǒng)需要高度專用、成本最佳化的元件以滿足市場(chǎng)需求。傳統(tǒng)MCU針對(duì)特殊應(yīng)用而設(shè)計(jì)的作法已不再適用，最佳化車用MCU設(shè)計(jì)方案由此誕生...

2014-01-03 標(biāo)簽：微控制器 FPGA ASIC 1.4k 0

IC設(shè)計(jì)中多時(shí)鐘域設(shè)計(jì)常用方法及其問(wèn)題

假如考慮處理器和存儲(chǔ)器的工作頻率為500MHz，帶有存儲(chǔ)器控制器的浮點(diǎn)引擎的工作頻率為666.66MHz，總線接口和高速接口工作頻率為250MHz，則該...

2022-08-01 標(biāo)簽：處理器 fpga asic 1.4k 0

Verilog 與 ASIC 設(shè)計(jì)的關(guān)系 Verilog 代碼優(yōu)化技巧

Verilog與ASIC設(shè)計(jì)的關(guān)系 Verilog作為一種硬件描述語(yǔ)言（HDL），在ASIC設(shè)計(jì)中扮演著至關(guān)重要的角色。ASIC（Application...

2024-12-17 標(biāo)簽：asic 硬件 Verilog 1.3k 0

如何構(gòu)建更涼爽、更密集的ASIC礦機(jī)鉆機(jī)

加密貨幣和其他區(qū)塊鏈技術(shù)是計(jì)算密集型的。目前的區(qū)塊鏈采礦設(shè)備依賴于數(shù)百個(gè)專用ASIC，這些ASIC消耗千瓦的功率進(jìn)行計(jì)算。用于為ASIC供電的轉(zhuǎn)換器必須...

2023-06-16 標(biāo)簽：轉(zhuǎn)換器電感器 asic 1.3k 0

AI增強(qiáng)型智能加速度計(jì)

技術(shù)日新月異，我們每天都走在創(chuàng)新的路上，獲取前沿的領(lǐng)域知識(shí)，并轉(zhuǎn)化為自己的成果，創(chuàng)造出更適合用戶的產(chǎn)品。在這一路上，貿(mào)澤電子始終會(huì)伴你左右，并隨時(shí)提供...

2023-07-12 標(biāo)簽：asic mems AI 1.3k 0

具有高級(jí)輸入和負(fù)載保護(hù)的10A μModule降壓型穩(wěn)壓器

總線電壓浪涌不僅對(duì) DC/DC 轉(zhuǎn)換器造成危險(xiǎn)，而且對(duì)負(fù)載也構(gòu)成危險(xiǎn)。涉及保險(xiǎn)絲的傳統(tǒng)過(guò)壓保護(hù)方案不一定足夠快，也不夠可靠，無(wú)法保護(hù)FPGA、ASIC和...

2023-04-19 標(biāo)簽：轉(zhuǎn)換器 ASIC 微處理器 1.3k 0

基于Virtex-5 LX110驗(yàn)證平臺(tái)實(shí)現(xiàn)FPGA性能的硬件系統(tǒng)設(shè)計(jì)

目前ASIC設(shè)計(jì)的規(guī)模在不斷擴(kuò)大、復(fù)雜度在不斷增加，與此同時(shí)，日益激烈的競(jìng)爭(zhēng)使得今天的電子產(chǎn)品市場(chǎng)對(duì)產(chǎn)品進(jìn)入市場(chǎng)的時(shí)間極為敏感。如何提高驗(yàn)證的效率已成為...

2020-09-30 標(biāo)簽：fpga asic Xilinx 1.3k 0

通過(guò)無(wú)引腳MicroPak和有引腳PicoGate邏輯封裝實(shí)現(xiàn)邏輯器件微型化

微型邏輯器件封裝的尺寸只有傳統(tǒng)SO封裝的1/15，在空間受限的移動(dòng)應(yīng)用中大幅縮小了占位面積，現(xiàn)在也可用于汽車應(yīng)用。

2023-02-10 標(biāo)簽：asic 逆變器邏輯器件 1.3k 0

Xilinx 推出擁有ASIC級(jí)架構(gòu)和ASIC增強(qiáng)型設(shè)計(jì)方案的20nm All Programmable UltraScale產(chǎn)品系列

All Programmable FPGA、SoC和3D IC的全球領(lǐng)先企業(yè)賽靈思公司（Xilinx， Inc. （NASDAQ:XLNX））今天...

2013-12-10 標(biāo)簽：FPGA ASIC Xilinx 1.3k 0

IC設(shè)計(jì)流程相關(guān)名詞梳理（含各流程EDA工具梳理）

對(duì)設(shè)計(jì)的功能進(jìn)行仿真驗(yàn)證，需要激勵(lì)驅(qū)動(dòng)，是動(dòng)態(tài)仿真。仿真驗(yàn)證工具M(jìn)entor公司的 Modelsim， Synopsys的VCS，還有Cadence的N...

2023-05-09 標(biāo)簽：asic IC設(shè)計(jì)測(cè)試芯片 1.3k 0

如何使用GreenPAK SLG46537V IC等可編程ASIC來(lái)開(kāi)發(fā)AVR

自動(dòng)電壓調(diào)節(jié)器（AVR）通常也稱為穩(wěn)壓器，它通過(guò)補(bǔ)償輸入電壓的波動(dòng)來(lái)調(diào)節(jié)供電電壓電平，在許多工業(yè)和住宅應(yīng)用中都很常見(jiàn)。例如，AVR被用于船舶發(fā)電機(jī)組、應(yīng)...

2022-07-10 標(biāo)簽：asic AVR 運(yùn)算放大器 1.3k 0

基于Freeze的FPGA低功耗設(shè)計(jì)

需要低功耗的半導(dǎo)體技術(shù)的應(yīng)用可以是電池供電的電器、具有可靠性考慮的熱敏感應(yīng)用，或者具有嚴(yán)格功率預(yù)算以及冷卻方法受限的交流電供電應(yīng)用。需要低功耗解決方案的...

2018-04-25 標(biāo)簽：fpga asic freeze 1.3k 0

保持混合信號(hào)ASIC中的安靜

高密度數(shù)字CMOS工藝提供的低晶圓成本使其成為混合信號(hào)ASIC的首選，特別是對(duì)于片上系統(tǒng)設(shè)計(jì)。能夠在對(duì)芯片面積影響最小的情況下添加大量亞微米邏輯門，這意...

2023-11-10 標(biāo)簽：asic 混合信號(hào)開(kāi)關(guān)噪聲 1.3k 0

淺談從FPGA到ASIC的人工智能芯片設(shè)計(jì)路

并行處理是最普遍的，也是AI加速器的基礎(chǔ)。它可以通過(guò)許多陣列的小型專用處理內(nèi)核(如特定算法的GPU)來(lái)實(shí)現(xiàn)，或者以數(shù)據(jù)流(即專用處理器的流水線)的方式來(lái)實(shí)現(xiàn)。

2023-12-19 標(biāo)簽：fpga asic RAM 1.3k 0

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Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
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識(shí)別

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FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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PCB封裝庫(kù)

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QuickPcb

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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Protel 99 se

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面包板

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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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