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ASIC是Application Specific Integrated Circuit的英文縮寫(xiě)，在集成電路界被認(rèn)為是一種為專(zhuān)門(mén)目的而設(shè)計(jì)的集成電路。ASIC也是Australian Securities and Investment Commission的英文縮寫(xiě)，即澳大利亞證券和投資委員會(huì)，它是澳大利亞金融服務(wù)和市場(chǎng)的法定監(jiān)管機(jī)構(gòu)。

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asic技術(shù)

FPGA工程的Verilog HDL初學(xué)者設(shè)計(jì)要點(diǎn)

要養(yǎng)成良好的Verilog代碼風(fēng)格，要先有硬件電路框圖之后再寫(xiě)代碼的習(xí)慣，設(shè)計(jì)出良好的時(shí)序，這樣才能在FPGA開(kāi)發(fā)或者ASIC設(shè)計(jì)中起到事半功倍的效果，...

2020-11-19 標(biāo)簽：fpga asic Verilog 4.1k 0

CXL SSD的性能會(huì)與NVMe SSD有何區(qū)別？

CXL和PCIe之間的區(qū)別可能不太明顯。在信號(hào)級(jí)別上，這兩者確實(shí)是相同的，但兩者的協(xié)議不同。CXL選擇比PCIe更快的協(xié)議，盡管CXL.io支持標(biāo)準(zhǔn)的P...

2023-04-11 標(biāo)簽：fpga 電容器 asic 4k 0

FPGA和ASIC的區(qū)別與聯(lián)系

　　FPGA和ASIC作為數(shù)字電路的常見(jiàn)實(shí)現(xiàn)方式，其聯(lián)系和區(qū)別備受關(guān)注。本文將從FPGA和ASIC的基本概念入手，深入研究它們的區(qū)別與聯(lián)系，以幫助讀者更...

2023-08-14 標(biāo)簽：fpga 邏輯電路 asic 4k 0

低成本ASIC技術(shù)會(huì)替代PCB？

傳統(tǒng)上若要將采用標(biāo)準(zhǔn)零件的電路板設(shè)計(jì)縮小，就是把邏輯與外圍電路整合設(shè)計(jì)成客制化ASIC，再焊到PC電路板上搭配外部?jī)?nèi)存芯片

2020-09-24 標(biāo)簽：印刷電路板 asic 硅電路板 4k 0

Xilinx UltraScale：為您未來(lái)架構(gòu)而打造的新一代架構(gòu)

UltraScale架構(gòu)是業(yè)界首次在All Programmable架構(gòu)中應(yīng)用最先進(jìn)的ASIC架構(gòu)優(yōu)化。該架構(gòu)能從20nm平面FET結(jié)構(gòu)擴(kuò)展至16nm鰭...

2013-07-15 標(biāo)簽：ASIC Xilinx 20nm 3.9k 0

采用ASIC與分立元件研究家用電器中應(yīng)用功能安全

針對(duì)家用電器的安全標(biāo)準(zhǔn)和立法的最新發(fā)展和增強(qiáng)包括針對(duì)有人值守使用設(shè)備的 IEC 60335、針對(duì)無(wú)人值守使用的 IEC 60730 和針對(duì)鋰離子電池的 ...

2022-05-13 標(biāo)簽：mcu asic 3.9k 0

優(yōu)秀的IC/FPGA開(kāi)源項(xiàng)目(二)-NetFPGA

從上面的工作可以看出DPU的核心是：網(wǎng)絡(luò)。所以我們今天講一個(gè)未來(lái)的發(fā)展核心之一：用FPGA實(shí)現(xiàn)NIC（network interface control...

2023-05-19 標(biāo)簽：fpga asic cpu 3.9k 0

TPU深度解析一文搞懂 TPU 谷歌專(zhuān)用集成電路(ASIC)

簡(jiǎn)單來(lái)說(shuō)，TPU 是谷歌的專(zhuān)用集成電路 (ASIC)，專(zhuān)注于兩個(gè)因素：極高的矩陣乘法吞吐量 + 高能效。TPU 的主要優(yōu)勢(shì)在于其可擴(kuò)展性。這是通過(guò)硬件（...

2025-07-01 標(biāo)簽：FPGA asic gpu 3.9k 0

適用于Altera FPGA的電源解決方案

現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）用于各種應(yīng)用和終端市場(chǎng)，由于其出色的設(shè)計(jì)靈活性和低工程成本，它們已經(jīng)獲得了超過(guò)ASIC的市場(chǎng)份額。FPGA 的電源設(shè)計(jì)和管理...

2023-01-17 標(biāo)簽：電源 fpga asic 3.8k 0

FPGA設(shè)計(jì)流程和技術(shù)規(guī)范

本部門(mén)所承擔(dān)的FPGA設(shè)計(jì)任務(wù)主要是兩方面的作用：系統(tǒng)的原型實(shí)現(xiàn)和ASIC的原型驗(yàn)證。編寫(xiě)本流程的目的是：

2022-03-15 標(biāo)簽：fpga asic 存儲(chǔ)器 3.8k 0

基于使用FPGA實(shí)現(xiàn)低延遲的成像系統(tǒng)

上面的架構(gòu)是比較通用的架構(gòu)，官方也有例程可以參考，但是上面架構(gòu)多了一個(gè)VDMA，這就導(dǎo)致視頻傳輸?shù)臅r(shí)候有1到幾幀的延遲，這對(duì)于低延遲、高分辨率的情形肯定...

2022-10-08 標(biāo)簽：fpga asic 成像系統(tǒng) 3.8k 0

可行的平臺(tái)ASIC解決方案用于實(shí)現(xiàn)芯片上的定制系統(tǒng)

雖然需要定制邏輯解決方案的系統(tǒng)設(shè)計(jì)人員越來(lái)越多地面臨新的技術(shù)挑戰(zhàn)，但他們?cè)诙ㄖ菩酒a(chǎn)品方面擁有新的進(jìn)步和選擇。其中一個(gè)選擇是基于單元的ASIC和平臺(tái)AS...

2019-10-06 標(biāo)簽：asic 3.7k 0

在ASIC中采用VHDL語(yǔ)言實(shí)現(xiàn)異步FIFO的設(shè)計(jì)

異步FIFO廣泛應(yīng)用于計(jì)算機(jī)網(wǎng)絡(luò)工業(yè)中進(jìn)行異步數(shù)據(jù)傳送，這里的異步是指發(fā)送用一種速率而接收用另一速率，因此異步FIFO有兩個(gè)不同的時(shí)鐘，一個(gè)為讀同步時(shí)鐘...

2019-06-11 標(biāo)簽：控制器 asic 觸發(fā)器 3.7k 0

為什么不把每一個(gè)類(lèi)似的解決方案都構(gòu)建為ASIC呢?

PHY連接到包中的高帶寬內(nèi)存(HBM2)堆棧。值得注意的是，eSilicon在芯片和封裝級(jí)別的3D和2.5D系統(tǒng)構(gòu)建方面擁有豐富的經(jīng)驗(yàn)，包括在模具和封裝...

2018-09-03 標(biāo)簽：ASIC 人工智能 AI芯片 3.7k 0

為ASIC和SoC設(shè)計(jì)實(shí)現(xiàn)最佳化嵌入式存儲(chǔ)器

　在傳統(tǒng)的大規(guī)模ASIC和SoC設(shè)計(jì)中，晶片的實(shí)體空間大致可分為用于新的定制邏輯、用于可再使用邏輯（第三方IP或傳統(tǒng)的內(nèi)部IP）以及用于嵌入式存儲(chǔ)器三部份。

2013-07-10 標(biāo)簽：ASIC Soc 嵌入式存儲(chǔ)器 3.7k 0

ASIC在加密貨幣中應(yīng)用的障礙

許多人對(duì)ASIC的悲觀態(tài)度持續(xù)了很長(zhǎng)時(shí)間，并且也有足夠的理由。不過(guò)通用計(jì)算芯片像CPU、GPU甚至DRAM為了滿(mǎn)足通用計(jì)算需求都不能真正發(fā)揮其計(jì)算性能，...

2018-05-16 標(biāo)簽：芯片 ASIC 3.7k 0

采用FPGA的原型開(kāi)發(fā)板進(jìn)行ASIC驗(yàn)證與開(kāi)發(fā)設(shè)計(jì)

在不太遙遠(yuǎn)的過(guò)去，對(duì)ASIC設(shè)計(jì)團(tuán)隊(duì)而言，在這類(lèi)情況下主要的解決方案就是在內(nèi)部建立他們自己的定制多個(gè)FPGA的原型開(kāi)發(fā)板。然而，今天，使用現(xiàn)成的多個(gè)FP...

2019-05-16 標(biāo)簽：fpga asic soc 3.7k 0

“萬(wàn)能芯片”FPGA在深度學(xué)習(xí)領(lǐng)域的用法

而眾所周知，在專(zhuān)用芯片與通用芯片中間，還有一個(gè)更為靈活，也更為神秘的領(lǐng)域：FPGA。無(wú)論是英特爾天價(jià)的收購(gòu)還是微軟與 IBM 雄心勃勃的計(jì)劃，都讓人對(duì)其...

2018-07-02 標(biāo)簽：fpga asic 深度學(xué)習(xí) 3.6k 0

FPGA在網(wǎng)絡(luò)安全產(chǎn)品設(shè)計(jì)中的作用 IPS上的奇葩還是到期的契約？

在網(wǎng)絡(luò)安全產(chǎn)品設(shè)計(jì)的時(shí)候，可以采用多種半導(dǎo)體解決方案，相對(duì)來(lái)講，目前主要采用的體系架構(gòu)包括了x86、NP、ASIC、FPGA四種。其中，CPU與NP的聯(lián)...

2018-04-18 標(biāo)簽：fpga asic xilinx 3.6k 0

多業(yè)務(wù)光接入平臺(tái)GW7980的功能特性與設(shè)計(jì)

El HDB3接口碼型變換電路是按ITU-T G.703建議規(guī)定設(shè)計(jì)的，該碼是產(chǎn)品與產(chǎn)品間電信號(hào)傳輸接口的規(guī)定碼型。它是三階高密度雙極性碼，這種三電平碼...

2018-11-05 標(biāo)簽：芯片轉(zhuǎn)換器以太網(wǎng) 3.5k 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線(xiàn)束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

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powerlink

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Protel 99 se

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面包板

面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

AXI

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AXI是一種總線(xiàn)協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線(xiàn)。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪(fǎng)問(wèn)和亂序訪(fǎng)問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線(xiàn)傳輸中的概念。特性阻抗是射頻傳輸線(xiàn)影響無(wú)線(xiàn)電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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