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      標(biāo)簽　>　axi總線(xiàn)

      axi總線(xiàn)

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      axi總線(xiàn)技術(shù)

      ARM和FPGA究竟是如何進(jìn)行通信的呢？

      ZYNQ擁有ARM+FPGA這個(gè)神奇的架構(gòu)，那么ARM和FPGA究竟是如何進(jìn)行通信的呢？本章通過(guò)剖析AXI總線(xiàn)源碼，來(lái)一探其中的秘密。

      2023-02-16 標(biāo)簽：fpgaarmDDR 1.5萬(wàn) 0

      簡(jiǎn)單講解AXI Interconnect IP核的使用方法

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      最近需要用到AXI接口的模塊，xilinx的IP核很多都用到了AXI總線(xiàn)進(jìn)行數(shù)據(jù)和指令傳輸。如果有多個(gè)設(shè)備需要使用AXI協(xié)議對(duì)AXI接口的BRAM進(jìn)行讀...

      2023-06-19 標(biāo)簽：控制器RTLVCS 1.4萬(wàn) 0

      SoC設(shè)計(jì)中總線(xiàn)協(xié)議AXI4與AXI3的主要區(qū)別詳解

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      AXI4和AXI3是高級(jí)擴(kuò)展接口（Advanced eXtensible Interface）的兩個(gè)不同版本，它們都是用于SoC（System on C...

      2024-05-10 標(biāo)簽：處理器寄存器數(shù)據(jù)傳輸 1.2萬(wàn) 0

      AMD Versal AI Edge自適應(yīng)計(jì)算加速平臺(tái)之PL通過(guò)NoC讀寫(xiě)DDR4實(shí)驗(yàn)(4)

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      Versal的DDR4是通過(guò)NoC訪(fǎng)問(wèn)，因此需要添加NoC IP進(jìn)行配置。

      2024-03-22 標(biāo)簽：JTAGDDR4AXI總線(xiàn) 1.1萬(wàn) 0

      AXI4 、 AXI4-Lite 、AXI4-Stream接口

      AXI4 是一種高性能memory-mapped總線(xiàn)，AXI4-Lite是一只簡(jiǎn)單的、低通量的memory-mapped 總線(xiàn)，而 AXI4-Strea...

      2022-07-04 標(biāo)簽：微控制器AXI總線(xiàn) 1.0萬(wàn) 0

      如何實(shí)現(xiàn)FPGA中的除法運(yùn)算

      FPGA中的硬件邏輯與軟件程序的區(qū)別，相信大家在做除法運(yùn)算時(shí)會(huì)有深入體會(huì)。若其中一個(gè)操作數(shù)為常數(shù)，可通過(guò)簡(jiǎn)單的移位與求和操作代替，但用硬件邏輯完成兩變量...

      2022-04-27 標(biāo)簽：fpga除法運(yùn)算AXI總線(xiàn) 8.7k 0

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      一般而言，DMA控制器的功能與結(jié)構(gòu)是由本單位特定的系統(tǒng)結(jié)構(gòu)決定的。但是作為IP而言，DMA控制器又要有其一般性。DMA是指外部設(shè)備直接對(duì)計(jì)算機(jī)存儲(chǔ)器進(jìn)行...

      2017-12-07 標(biāo)簽：AXI總線(xiàn)DMA控制器 6.9k 0

      基于AXI總線(xiàn)的DDR3讀寫(xiě)測(cè)試

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      本文開(kāi)源一個(gè)FPGA項(xiàng)目：基于AXI總線(xiàn)的DDR3讀寫(xiě)。之前的一篇文章介紹了DDR3簡(jiǎn)單用戶(hù)接口的讀寫(xiě)方式：《DDR3讀寫(xiě)測(cè)試》，如果在某些項(xiàng)目中，我們...

      2023-09-01 標(biāo)簽：fpgaDDR3接口 6.8k 0

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      首先對(duì)本次工程進(jìn)行簡(jiǎn)要說(shuō)明：本次工程使用AXI-Full接口的IP進(jìn)行DDR的讀寫(xiě)測(cè)試。在我們的DDR讀寫(xiě)IP中，我們把讀寫(xiě)完成和讀寫(xiě)錯(cuò)誤信號(hào)關(guān)聯(lián)到PL...

      2022-07-18 標(biāo)簽：DDRAXI總線(xiàn)SDK 6.7k 0

      【芯片設(shè)計(jì)】握手協(xié)議的介紹與時(shí)序說(shuō)明

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      最早接觸到握手協(xié)議是在校期間學(xué)習(xí)PCIe的AXI總線(xiàn)時(shí)，至今日雖然PCIe的結(jié)構(gòu)已經(jīng)忘得一干二凈，但握手協(xié)議經(jīng)過(guò)不斷的使用還算掌握的不錯(cuò)。

      2023-12-11 標(biāo)簽：芯片設(shè)計(jì)AXI總線(xiàn)PCIe接口 5.1k 0

      進(jìn)行RTL代碼設(shè)計(jì)需要考慮時(shí)序收斂的問(wèn)題

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      引言 硬件描述語(yǔ)言（verilog，systemVerilog，VHDL等）不同于軟件語(yǔ)言（C，C++等）的一點(diǎn)就是，代碼對(duì)應(yīng)于硬件實(shí)現(xiàn)，不同的代碼風(fēng)格...

      2020-11-20 標(biāo)簽：fpga寄存器RTL 4.6k 0

      基于MicroBlaze的AXI總線(xiàn)實(shí)時(shí)時(shí)鐘IP核設(shè)計(jì)

      作者：薩其日娜 內(nèi)蒙古魯電電力工程有限公司 摘要: 應(yīng)用MicroBlaze軟核作為CPU的硬件平臺(tái)，在此平臺(tái)上設(shè)計(jì)了基于AXI總線(xiàn)的通用實(shí)時(shí)時(shí)鐘IP核...

      2017-11-17 標(biāo)簽：microblazeaxi總線(xiàn) 4.3k 0

      使用Vivado Block Design設(shè)計(jì)解決項(xiàng)目繼承性問(wèn)題

      使用Vivado Block Design設(shè)計(jì)解決了項(xiàng)目繼承性問(wèn)題，但是還有個(gè)問(wèn)題，不知道大家有沒(méi)有遇到，就是新設(shè)計(jì)的自定義 RTL 文件無(wú)法快速的添加...

      2023-02-13 標(biāo)簽：HDLRTLAXI總線(xiàn) 4.1k 0

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      2023-06-07 標(biāo)簽：fpgaDDRQoS 3.7k 0

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      關(guān)于AXI總線(xiàn)協(xié)議的一些簡(jiǎn)單知識(shí)，通過(guò)閱讀Xilinx的使用指導(dǎo)手冊(cè)（UG1037），結(jié)合正點(diǎn)原子的ZYNQ視頻進(jìn)行梳理總結(jié)。

      2022-07-15 標(biāo)簽：存儲(chǔ)器接口AXI總線(xiàn) 3.7k 0

      在Vivado中使用SRIO高速串行協(xié)議的IP演示

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      在FPGA開(kāi)發(fā)過(guò)程中不可避免的要使用到一些IP，有些IP是很復(fù)雜的，且指導(dǎo)手冊(cè)一般是很長(zhǎng)的英文，僅靠看手冊(cè)和網(wǎng)絡(luò)的一些搜索，對(duì)于復(fù)雜IP的應(yīng)用可能一籌莫展。

      2023-06-21 標(biāo)簽：收發(fā)器sRIOPHY 3.5k 0

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      首先我們看一下針對(duì)AXI接口的IP設(shè)計(jì)，在介紹之前我們先回顧一下AXI所具有的一些feature。

      2024-02-20 標(biāo)簽：寄存器DDRCache 3.2k 0

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      2021-01-02 標(biāo)簽：寄存器cpuXilinx 3.2k 0

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      從直觀上來(lái)說(shuō)，性能好代表著快。那么如何評(píng)估”快”呢？首先芯片根據(jù)應(yīng)用場(chǎng)景分為很多不同的種類(lèi)，通信類(lèi)的5G，藍(lán)牙，wifi；接口類(lèi)的USB，以太網(wǎng)，HDM...

      2023-06-05 標(biāo)簽：HDMI以太網(wǎng)門(mén)電路 3.1k 0

      AMBA總線(xiàn)那些事之APB

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      之前老李問(wèn)過(guò)大家想看哪方面的知識(shí)，有不少同學(xué)提議老李寫(xiě)寫(xiě)總線(xiàn)，特別是AMBA的總線(xiàn)，所以老李決定從這期開(kāi)始開(kāi)始一個(gè)AMBA總線(xiàn)介紹的系列文章。AMBA總...

      2023-05-04 標(biāo)簽：AMBAAHBAXI總線(xiàn) 3k 0

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        HCS12X系列單片機(jī)簡(jiǎn)介 Freescale 公司的16位單片機(jī)主要分為HC12 、HCS12、HCS12X三個(gè)系列。HC12核心是16位高速CPU12核，總線(xiàn)速度8MHZ；HCS12系列單片機(jī)以速度更快的CPU12內(nèi)核為核心，簡(jiǎn)稱(chēng)S12系列，典型的S12總線(xiàn)速度可以達(dá)到25MHZ。
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