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標(biāo)簽 > ic設(shè)計(jì)
IC設(shè)計(jì)，Integrated Circuit Design，或稱為集成電路設(shè)計(jì)，是電子工程學(xué)和計(jì)算機(jī)工程學(xué)的一個(gè)學(xué)科，其主要內(nèi)容是運(yùn)用專業(yè)的邏輯和電路設(shè)計(jì)技術(shù)設(shè)計(jì)集成電路。
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什么是倒裝芯片 倒裝芯片技術(shù)的優(yōu)點(diǎn) 倒裝芯片封裝工藝流程
從事半導(dǎo)體行業(yè)，尤其是半導(dǎo)體封裝行業(yè)的人，總繞不開幾種封裝工藝，那就是芯片粘接、引線鍵合、倒裝連接技術(shù)。
2023-07-21 標(biāo)簽：電感器IC設(shè)計(jì)半導(dǎo)體封裝 8k 0
什么是ECO？ECO的應(yīng)用場景和實(shí)現(xiàn)流程
ECO指的是 Engineering Change Order ，即工程變更指令。目的是為了在設(shè)計(jì)的后期，快速靈活地做小范圍修改，從而盡可能的保持已經(jīng)驗(yàn)...
2023-04-23 標(biāo)簽：dspFPGA設(shè)計(jì)IC設(shè)計(jì) 7.8k 0
基于一款PWM控制型的高效恒流型LED驅(qū)動(dòng)IC設(shè)計(jì)
基本工作原理為：當(dāng)開關(guān)管導(dǎo)通時(shí)，主電流回路為 AC IN-F1-B1-LED-L1-Q1-R4-L2-B1-AC IN，此時(shí)AC給LED供電，并使電感L...
2019-09-19 標(biāo)簽：IC設(shè)計(jì)LED驅(qū)動(dòng)PWM控制 7.7k 0
芯片設(shè)計(jì)之模擬IC設(shè)計(jì)全流程分析
射頻芯片作為模擬電路王冠上的明珠，一直被認(rèn)為是芯片設(shè)計(jì)中的“華山之巔”。一方面因?yàn)樯漕l電路的物理形狀和周圍介質(zhì)分布會對射頻信號的傳輸造成很大影響。
2023-01-09 標(biāo)簽：模擬ICIC設(shè)計(jì)芯片設(shè)計(jì) 7.7k 0
淺談IC設(shè)計(jì)的逆向設(shè)計(jì)及基本流程
逆向設(shè)計(jì)非常適合模擬芯片設(shè)計(jì)，如ADC、DAC、鎖相環(huán)等模擬電路，因?yàn)槟M電路的設(shè)計(jì)往往靠經(jīng)驗(yàn)。此外，對于10萬門以下的數(shù)字電路也適合，對于混合信號電路...
2018-05-29 標(biāo)簽：IC設(shè)計(jì) 7.7k 1
為IC設(shè)計(jì)減少天線效應(yīng)的設(shè)計(jì)思路
天線效應(yīng)或電漿導(dǎo)致閘氧損害是指在MOS晶片制程中，可能發(fā)生潛在影響產(chǎn)品良率與可靠性的效應(yīng)。目前，微影制程采用‘電漿蝕刻’法（或‘干式蝕刻’）制造晶片。電...
2018-02-11 標(biāo)簽：ic設(shè)計(jì)天線效應(yīng) 7.7k 0
如何開始一款芯片設(shè)計(jì) 深度解讀集成電路產(chǎn)業(yè)自主可控性
首先，什么叫自主可控，最直觀的理解就是當(dāng)別人“卡脖子”的時(shí)候不會被卡住。集成電路產(chǎn)業(yè)通常被分為芯片設(shè)計(jì)、芯片制造、封裝測試三大領(lǐng)域，參看下圖： ? 我們...
2021-02-26 標(biāo)簽：集成電路IC設(shè)計(jì)soc 7.6k 0
數(shù)字IC的設(shè)計(jì)流程及驗(yàn)證方法介紹
定理證明是形式驗(yàn)證技術(shù)中最高大上的，它需要設(shè)計(jì)行為的形式化描述，通過嚴(yán)格的數(shù)學(xué)證明，比較HDL描述的設(shè)計(jì)和系統(tǒng)的形式化描述在所有可能輸入下是否一致。
2022-07-11 標(biāo)簽：IC設(shè)計(jì)模擬器 7.3k 0
分析LEC在IC設(shè)計(jì)中的重要性和應(yīng)用
在設(shè)置模式下，Conformal工具讀取兩個(gè)設(shè)計(jì)。我們指定設(shè)計(jì)類型，即Golden（綜合網(wǎng)表）和修訂版（通常，修改后的設(shè)計(jì)是Conformal工具與Go...
2019-08-28 標(biāo)簽：IC設(shè)計(jì)網(wǎng)絡(luò)觸發(fā)器 7.1k 0
解析IC設(shè)計(jì)中同步復(fù)位與異步復(fù)位的差異
異步復(fù)位是不受時(shí)鐘影響的，在一個(gè)芯片系統(tǒng)初始化（或者說上電）的時(shí)候需要這么一個(gè)全局的信號來對整個(gè)芯片進(jìn)行整體的復(fù)位，到一個(gè)初始的確定狀態(tài)。
2019-01-04 標(biāo)簽：IC設(shè)計(jì)同步復(fù)位異步復(fù)位 7k 0
用GreenPAK可配置混合信號IC設(shè)計(jì)非接觸式旋轉(zhuǎn)編碼器
DFF鎖存器保持ASM結(jié)果穩(wěn)定，以便在ASM復(fù)位期間不會切換最終輸出。驅(qū)動(dòng)開漏NMOS輸出引腳所需的極性，要求我們配置具有反相輸出的DFF。
2019-02-18 標(biāo)簽：混合信號IC設(shè)計(jì)dialog 7k 0
前一段時(shí)間IC君比較忙，沒有更新文章，最近稍微閑下來點(diǎn)，繼續(xù)更新Verdi相關(guān)的文章。
2023-04-25 標(biāo)簽：IC設(shè)計(jì)瀏覽器源代碼 6.9k 0
數(shù)字IC前端設(shè)計(jì)+后端設(shè)計(jì)流程實(shí)現(xiàn)
RTL 設(shè)計(jì)** ：芯片功能設(shè)計(jì)。硬件描述語言如 Verilog、VHDL、SystemVerilog。
2023-11-08 標(biāo)簽：緩沖器IC設(shè)計(jì)EDA工具 6.8k 0
模擬IC設(shè)計(jì)原理圖1：邏輯電路是如何通過MOS管實(shí)現(xiàn)的
今天來聊聊我們常用的邏輯電路是如何通過MOS管實(shí)現(xiàn)的。
2023-10-30 標(biāo)簽：邏輯電路IC設(shè)計(jì)MOS管 6.8k 0
ic設(shè)計(jì)是芯片設(shè)計(jì)嗎 數(shù)字ic設(shè)計(jì)流程及工具介紹
在IC設(shè)計(jì)中，設(shè)計(jì)師使用電路設(shè)計(jì)工具（如EDA軟件）來設(shè)計(jì)和模擬各種電路，例如邏輯電路、模擬電路、數(shù)字信號處理電路等。然后，根據(jù)設(shè)計(jì)電路的規(guī)格要求，進(jìn)行...
2023-08-30 標(biāo)簽：電路設(shè)計(jì)IC設(shè)計(jì)數(shù)字信號處理 6.7k 0
剛開始學(xué)習(xí)模擬電路？覺得學(xué)的云里霧里的？覺得老師講的不好？覺得教材爛？好了，別找理由了，學(xué)不好應(yīng)該是沒找到方法，分享3位前輩的經(jīng)驗(yàn)給你，看看前輩們都是怎...
2017-02-08 標(biāo)簽：電路分析模擬電路IC設(shè)計(jì) 6.5k 2
ic設(shè)計(jì)和fpga設(shè)計(jì)有什么不同 ic設(shè)計(jì)和ic驗(yàn)證哪個(gè)好
IC設(shè)計(jì)和IC驗(yàn)證都是非常重要的環(huán)節(jié)，一個(gè)好的IC產(chǎn)品需要二者的配合。IC設(shè)計(jì)是在滿足產(chǎn)品規(guī)格書的前提下，實(shí)現(xiàn)電路性能、功耗、面積等方面的優(yōu)化，從而滿足...
2023-04-13 標(biāo)簽：fpgaIC設(shè)計(jì) 6.5k 0
100個(gè)數(shù)字IC設(shè)計(jì)中常用的縮寫或術(shù)語
下面為大家收集了100個(gè)數(shù)字IC設(shè)計(jì)中常用的縮寫或術(shù)語，供大家參考，為初學(xué)者門的學(xué)習(xí)添磚加瓦。
2023-06-20 標(biāo)簽：IC設(shè)計(jì) 6.4k 0
??FPGA 的詳細(xì)開發(fā)流程就是利用 EDA 開發(fā)工具對 FPGA 芯片進(jìn)行開發(fā)的過程，所以 FPGA 芯片開發(fā)流程講的并不是芯片的制造流程，區(qū)分于 I...
2023-07-04 標(biāo)簽：fpga電路設(shè)計(jì)IC設(shè)計(jì) 6.4k 0
光掩膜版基本上是 IC 設(shè)計(jì)的“主模板”。掩模版有不同的尺寸。常見尺寸為 6 x 6 英寸一般的掩膜版由石英或玻璃基板組成。光掩膜版涂有不透明薄膜。更復(fù)...
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