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Vitis Model Composer 是一款 Xilinx 工具包，支持在 MATALB? 和 Simulink? 環(huán)境中進行快速設計探索和驗證，并加速 Xilinx 器件的量產(chǎn)。

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vitis技術

在Vitis中創(chuàng)建基于ARM的BareMetal程序設計

Create Application，選擇一個新的XSA文件，導入從Vivado獲得的XSA文件。

2022-06-08 標簽：arm 程序設計 Vitis 2.7k 0

《基于“礦板”低成本學習Zynq系列》之七-memory測試

2023-07-19 標簽：仿真 Memory 編譯 2.6k 0

如何在Vitis HLS中使用C語言代碼創(chuàng)建AXI4-Lite接口

您是否想創(chuàng)建自己帶有 AXI4-Lite 接口的 IP 卻感覺無從著手？本文將為您講解有關如何在 Vitis HLS 中使用 C 語言代碼創(chuàng)建 AXI4...

2022-07-08 標簽：接口 C語言 AXI4 2.6k 0

《基于“礦板”低成本學習Zynq系列》之十-RSA加密程序認證

前面我們測試了DDR，片上memory，片內外設等都OK，也進行了跑分，基本可以確認SOC沒問題了，我們現(xiàn)在來測試下加密。

2023-07-20 標簽：DDR soc 程序 2.5k 0

Vitis AI1.1系列教程1——軟件安裝

本博文介紹Vitis AI1.1 系列軟件安裝教程。

2022-07-25 標簽：fpga Vitis 2.4k 0

如何在Vitis中使用Git集成以及如何使用團隊操作來共享Vitis工程

在上述兩種情況下，用戶始終都能使用 “Refresh Project Models”（刷新工程模型）選項從 Git 倉庫獲取最新更改，在 “System...

2023-05-12 標簽：Git 資源管理器 Vitis 2.4k 0

理解Vitis HLS默認行為

相比于VivadoHLS，Vitis HLS更加智能化，這體現(xiàn)在Vitis HLS可以自動探測C/C++代碼中可并行執(zhí)行地部分而無需人工干預添加prag...

2022-11-24 標簽：函數(shù)C++HLS 2.3k 0

Vitis HLS工具在Standalone模式下調用Xilinx Vision Library L1 API例程

在論壇上遇到在高層次綜合工具中調用視覺庫遇到的大多數(shù)問題都和 opencv 庫以及Xilinx Vision 庫的安裝路徑有關，如今 Vitis HLS...

2022-07-25 標簽：fpga opencv Vitis 2.3k 0

如何使用Vitis-AI加速YOLOX模型實現(xiàn)視頻中的目標檢測

本文將介紹如何使用Vitis-AI加速YOLOX模型實現(xiàn)視頻中的目標檢測，并對相關源碼進行解讀。由于演示的示例程序源碼是Vitis-AI開源項目提供的，...

2023-10-16 標簽：AI DPU 模型 2.2k 0

VCK5000運行Vitis-AI 3.0 WeGO實時量化演示

VCK5000在vitis ai 3.0對應的shell版本為xilinx-vck5000-gen4x8-qdma-base_2

2023-07-07 標簽：AI 命令 Shell 2.2k 0

《基于“礦板”低成本學習Zynq系列》之九-廉頗老矣否,雖礦也要跑個分

前面我們測試了DDR，片上memory，片內外設等都OK，那么現(xiàn)在我們就來跑個分看卡你性能怎么樣。

2023-07-20 標簽：芯片 DDR 開發(fā)板 2k 0

使用AMD Vitis進行嵌入式設計開發(fā)用戶指南

由于篇幅有限，本文僅選取部分內容進行分享。 Vitis 簡介 AMD Vitis 工具套件包含多種設計技術，用于開發(fā)以 AMD 器件（例如，AMD Ve...

2025-01-08 標簽：amd 嵌入式設計 Vitis 2k 0

使用Vitis AI在Zynq MP上實現(xiàn)手勢識別

FPGA得益于其高可編程性以及低延遲，低功耗的特點，在機器學習的推理領域已獲得了廣泛的關注。在過去，F(xiàn)PGA對于軟件開發(fā)人員來說有較高的開發(fā)門檻，把一部...

2023-06-25 標簽：fpga 手勢識別 AI 1.9k 0

如何獲取和使用Github上的Vitis開放資源

自從 Vitis 的發(fā)布，AMD 在 Github 上也開源了很多資源，方便開發(fā)者進行自己的設計，減少產(chǎn)品上市時間。所以我們來看一下如何獲取和使用 Gi...

2023-08-23 標簽：amd Xilinx 開源 1.7k 0

如何在Vitis中把設置信息傳遞到底層的Vivado

在Vitis完成這個過程的底層，實際調用的是Vivado。Vitis會指定默認的Vivado策略來執(zhí)行綜合和實現(xiàn)的步驟。當默認的Vivado策略無法達到...

2022-08-02 標簽：Vivado Vitis 1.7k 0

Vitis IDE入門helloworld程序

第一個Xilinx Vitis IDE入門helloworld程序

2022-07-25 標簽：Xilinx IDE Vitis 1.7k 0

Vitis IDE Git集成快速入門

在本快速入門演示中，將探討如何在 Vitis 中使用 Git 集成以及如何使用團隊操作來共享 Vitis 工程。

2023-05-12 標簽：Xilinx IDE Git 1.7k 0

Vitis AI Library體驗之OCR識別

Vitis AI Library是一組高層次庫和 API，專為利用 DPU 高效執(zhí)行 AI 推斷而構建。它是基于 Vitis AI運行時利用 Vitis...

2023-10-17 標簽：神經(jīng)網(wǎng)絡 AI OCR 1.7k 0

使用AMD Vitis Unified IDE創(chuàng)建HLS組件

這篇文章在開發(fā)者分享｜AMD Vitis HLS 系列 1 - AMD Vivado IP 流程（Vitis 傳統(tǒng) IDE）的基礎上撰寫，但使用的是 ...

2025-06-20 標簽：amd 嵌入式 Vivado 1.7k 0

《基于“礦板”低成本學習Zynq系列》之八-定時器等外設測試

前面我們測試了DDR，片上memory，這一篇繼續(xù)測試片上外設，定時器等，以確認SOC是否正常。

2023-07-20 標簽：DDR soc 定時器 1.6k 0

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