如今,設(shè)計(jì)復(fù)雜性和空間限制迫使設(shè)計(jì)師采用創(chuàng)新的解決方案。將晶粒置于空腔內(nèi)是一種最常見(jiàn)也最有效的技術(shù),如果您是為汽車(chē)行業(yè)或微波/電信領(lǐng)域設(shè)計(jì)應(yīng)用,那么則很有可能也使用過(guò)這種技術(shù)。
Allegro Package Designer Plus 提供一整套工具集,適用于各個(gè)流程,從空腔設(shè)計(jì)到特定空腔的設(shè)計(jì)規(guī)則檢查 (DRC),再到制造。
在本文中,我們將詳細(xì)探討體育場(chǎng)型開(kāi)放空腔式封裝的引線接合步驟:
將晶粒置于體育場(chǎng)型開(kāi)放空腔內(nèi)
定義“金手指”,并對(duì)晶粒進(jìn)行引線接合
設(shè)置空腔組裝檢查,檢查組裝問(wèn)題并查看 DRC
查看 3D 模型并檢查 DRC
01
將晶粒置于體育場(chǎng)型開(kāi)放空腔內(nèi)
使用 Die-stack Editor 可以輕松將晶粒置于空腔內(nèi):
選擇 Edit - Die Stack,打開(kāi) Die - Stack Editor。
從下拉列表 Sits on layer 中選擇層。
設(shè)置空腔邊緣間隙和每層的擴(kuò)展值,制造體育場(chǎng)型開(kāi)放空腔。
應(yīng)用這些變更設(shè)置,可在設(shè)計(jì)中自動(dòng)創(chuàng)建體育場(chǎng)型開(kāi)放空腔。還會(huì)在創(chuàng)建空腔的層上標(biāo)明不允許布線的區(qū)域,并在頂部基板層標(biāo)明不允許放置器件的限制區(qū)。
下圖展示了在空腔中放置晶粒的過(guò)程。根據(jù)間隙和擴(kuò)展值創(chuàng)建體育場(chǎng)型開(kāi)放空腔。Die-stack Editor 中的報(bào)告也會(huì)更新,顯示與空腔有關(guān)的變更。
02
晶粒引線接合
要開(kāi)始引線接合,首先要在空腔內(nèi)定義“金手指”:
選擇 Route – Wire Bond – Settings。
在 Wire Bond Settings 對(duì)話框中,選擇 Allow Cavity Placement 選項(xiàng),再點(diǎn)擊 OK。
該選項(xiàng)允許在“內(nèi)部”層創(chuàng)建“金手指”。
要開(kāi)始引線接合,選擇 Route – Wire Bond – Add。
添加引線接合時(shí),在 Options 窗格中點(diǎn)擊 Add,以定義一個(gè)新的金手指焊盤(pán)。
Bond Finger Padstack Information 表格隨即打開(kāi),可在下拉列表中看到可選用的內(nèi)部層。
選擇其他內(nèi)部層,或是繼續(xù)使用相同的層,在 Bond Finger Padstack Information 表格中點(diǎn)擊 OK。
重復(fù)上述步驟,完成“金手指”放置。
下圖展示了 放置在內(nèi)部層上的“金手指” 。
03
設(shè)置空腔的組裝規(guī)則
對(duì)于特定于引線接合的空腔設(shè)計(jì),有多種組裝規(guī)則。要選擇和應(yīng)用這些規(guī)則,請(qǐng)通過(guò) Manufacture – Assembly Rules Checker 打開(kāi) Assembly Design Rules Checks 對(duì)話框。在 Cavity 類(lèi)別下啟用 Bond Fingers to Cavity Spacing 約束條件,然后點(diǎn)擊 OK。
批處理 DRC 流程會(huì)運(yùn)行并生成報(bào)告??梢栽谠O(shè)計(jì)中看到 DRC 標(biāo)記,表示違反檢查規(guī)則。使用 Show Element 命令并選擇一個(gè)標(biāo)記,查看違反約束的細(xì)節(jié)。
對(duì)于特定于空腔的引線接合設(shè)計(jì),有更多組裝檢查,位于 Wire Spacing Assembly 規(guī)則選項(xiàng)下。
04
查看 3D 模型和 DRC
3D Viewer 支持空腔設(shè)計(jì)。運(yùn)行 View ─ 3D Model,啟動(dòng) Cadence 3D Viewer。設(shè)置 3D DRC 規(guī)則,在設(shè)計(jì)中驗(yàn)證 DRC。下圖展示了空腔中的晶粒,其中“金手指”是落在不同層上面。
結(jié)論
Allegro Package Designer Plus 提供了一套全面的功能,可成功創(chuàng)建帶空腔的設(shè)計(jì)封裝。
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