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Quartus Prime Pro 25.1版本的安裝和使用

友晶FPGA ? 來源:友晶FPGA ? 2025-10-07 13:06 ? 次閱讀
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如果用戶開發(fā)板是基于Agilex 3、Agilex 5等高階器件,則需要安裝高版本的Quartus軟件比如Quartus Prime Pro 25.1版本,這個版本在安裝包和license獲?。赓M)等方面跟以往的Quartus軟件略有不同,本文將一步步演示該版本的軟件安裝、工程創(chuàng)建和仿真驗證。

一 安裝Quartus 軟件

進入Altera官網(wǎng)選擇Quartus Prime Pro 25.1版本:

3f77a6f6-98e4-11f0-8c8f-92fbcf53809c.png

然后點擊Individual Files,選擇Quartus Prime Pro Edition Part 1&Part2、 Ashling RiscFree IDE Altera(如果創(chuàng)建Nios V 工程則需要該文件包) 、 QuestaSetup-25.1.0.129-windows.exe、Agilex 3 器件支持包(如果是Agilex5的板子則下載Agilex 5 器件支持包)、Agilex common 文件共6個文件并下載:

3fd861c6-98e4-11f0-8c8f-92fbcf53809c.png

40353bbc-98e4-11f0-8c8f-92fbcf53809c.png

408e8762-98e4-11f0-8c8f-92fbcf53809c.png

40e88ec4-98e4-11f0-8c8f-92fbcf53809c.png

所有文件都下載完以后,雙擊QuartusProSetup-25.1.0.129-windows.exe文件進行安裝。安裝的過程中會默認選擇一起安裝Ashling RiscFree IDE和Agilex3器件包以及Questa等,建議安裝的過程中所有默認設置都保留(除了安裝路徑自己選擇外)。USB Blaster III驅動程序將在軟件安裝結束時安裝如下圖所示:

413ec956-98e4-11f0-8c8f-92fbcf53809c.png

重要提示:Altera Agilex 5、Agilex 3的開發(fā)人員能夠免費訪問Intel Quartus Pro Edition軟件-無需額外購買許可證,從而充分利用Quartus Pro的設計和編譯功能。有關如何獲得免費許可證的詳細信息,請參閱英特爾的官方指南:Acquiring Free No-Cost Licenses for Intel Agilex 5 Devices或者直接參考以下步驟:雙擊電腦桌面Quartus Prime Pro 25.1 的圖標打開Quartus, 點擊菜單Tools——License Setup, 然后點擊 Get no-cost licenses, 將如下復選框全部選上:

419bcb4c-98e4-11f0-8c8f-92fbcf53809c.png

這時會提示仿真器Questa的license文件位置,并提醒用戶去設置環(huán)境變量:

41f6b110-98e4-11f0-8c8f-92fbcf53809c.png

打開電腦的環(huán)境變量設置窗口,如點擊 系統(tǒng)信息——高級系統(tǒng)設置——環(huán)境變量——新建,變量名填入LM_LICENSE_FILE, 變量值填入Questa license文件quartus2_lic.dat的路徑:

424e3ac0-98e4-11f0-8c8f-92fbcf53809c.png

返回到Quartus軟件界面,最后點擊OK關閉掉該License Setup窗口。

42b0675e-98e4-11f0-8c8f-92fbcf53809c.png

二 創(chuàng)建工程

本文將演示一個簡單全加器的工程設計。

1. 雙擊桌面的Quartus圖標打開Quartus工具。

4310a04c-98e4-11f0-8c8f-92fbcf53809c.png

2. 點擊File——New Project Wizard...——Next,然后指定工程路徑,編輯工程名稱。

43671058-98e4-11f0-8c8f-92fbcf53809c.png

3. 點擊Next,器件選擇A3CZ135BB18AE7S(這個器件正好是DE23-Lite開發(fā)板上對應的FPGA device):

43c5d4c6-98e4-11f0-8c8f-92fbcf53809c.png

4. 繼續(xù)點擊Next,然后點擊Finish關閉窗口。

5. 點擊File——New,選擇Verilog HDL File,點擊OK來創(chuàng)建top文件。將如下代碼拷貝到新建的文件,并保存為full_adder.v:

module full_adder(
inputa,
inputb,
inputcin,
 outputsum,
 output cout
);


assignsum= a ^ b ^ cin;       //將a、b、cin進行與或運算,賦值給sum


assign cout= (a & b) | ((a^b) & cin); //將a、b、cin進行組合邏輯運算,賦值給cout


endmodule

6. 點擊File——New,選擇Verilog HDL File,點擊OK來創(chuàng)建tb文件。將如下代碼拷貝到新建的文件,并保存為full_adder_tb.v:

`timescale1ns /1ns        //設定時間單位和時間精度,時延單位為1ns,時延精度為1ns
module full_adder_tb;       //待測試的加法器模塊
 reg a,b,cin;          //數(shù)據(jù)輸入
 wire sum,cout;         //輸出信號
 parameter DELAY=50;       //設置延遲參數(shù)為50


full_adderu_full_adder(     //例化被測試模塊
  a,
  b,
cin,
  sum,
cout
 );


 initial        //使用initial過程快定義激勵信號波形
  begin        //使用begin-end控制語句
   a =1'b0; b = 1'b0; cin =1'b0;    //初始化輸入,被加數(shù)a被賦值為0,加數(shù)b被賦值為0,進位輸入c被賦值為0,此時加和sum和進位輸出cout都應該為0
  #DELAYa = 1'b1; b =1'b0; cin = 1'b0;//在50ns時,被加數(shù)a被賦值為1,加數(shù)b被賦值為0,進位輸入c被賦值為0,此時加和sum應該為1,進位輸出cout應該為0
  #DELAY a = 1'b0; b = 1'b1; cin = 1'b1; //在100ns時,被加數(shù)a被賦值為0,加數(shù)b被賦值為1,進位輸入c被賦值為1,此時加和sum應該為0,進位輸出cout應該為1
  #DELAY a = 1'b1; b = 1'b1; cin = 1'b0; //在150ns時,被加數(shù)a被賦值為1,加數(shù)b被賦值為1,進位輸入c被賦值為0,此時加和sum應該為0,進位輸出cout應該為1
  #DELAY a = 1'b1; b = 1'b1; cin = 1'b1; //在200ns時,被加數(shù)a被賦值為1,加數(shù)b被賦值為1,進位輸入c被賦值為1,此時加和sum應該為1,進位輸出cout應該為1
  #DELAY $stop;             //在250ns時,執(zhí)行$stop系統(tǒng)任務,停止仿真
 end


 initial    $monitor($time,,,"a=%b,b=%b,cin=%b,sum=%b,cout=%b",a,b,cin,sum,cout);//執(zhí)行monitor系統(tǒng)任務,設置顯示結果的格式


endmodule

三 Questa 仿真

首先確保Questa 的license已經獲取(參考第一部分license獲取內容):

4421dd0c-98e4-11f0-8c8f-92fbcf53809c.png

并且環(huán)境變量已經設置好了(參考第一部分license獲取內容):

44844d8e-98e4-11f0-8c8f-92fbcf53809c.png

打開Quartus Tools-->Options,在EDA Tool Options里設置Questa工具路徑,如下圖所示。

44de1f9e-98e4-11f0-8c8f-92fbcf53809c.png

點擊Assignment——Settings...——EDA Tool Settings去指定仿真工具,指定仿真文件:

453eef36-98e4-11f0-8c8f-92fbcf53809c.png

459ae2c8-98e4-11f0-8c8f-92fbcf53809c.png

最后點擊Apply 和OK關閉當前窗口:

45f56ae0-98e4-11f0-8c8f-92fbcf53809c.png

設置好后點擊Quartus Tools-->Run Simulation Tool-->RTL Simulation即可運行仿真(這個過程會自動對工程進行分析和綜合的操作)。

4654e4c0-98e4-11f0-8c8f-92fbcf53809c.png

: 若在運行RTL Simulation時沒有Questa 軟件出現(xiàn),可能是license文件的環(huán)境變量沒有設置,或者是設置了環(huán)境變量但沒有重啟Quartus軟件讓變量生效。

聲明:本文內容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權轉載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內容侵權或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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原文標題:最新版Quartus Prime Pro 25.1 的安裝和使用演示(含Questa仿真)

文章出處:【微信號:友晶FPGA,微信公眾號:友晶FPGA】歡迎添加關注!文章轉載請注明出處。

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