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      標(biāo)簽　>　fpga設(shè)計(jì)

      fpga設(shè)計(jì)

      fpga設(shè)計(jì)

      +關(guān)注9人關(guān)注

      FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

      文章：348個(gè) 瀏覽：27909次 帖子：91個(gè)

      fpga設(shè)計(jì)技術(shù)

      基于Xilinx Kintex開源的FPGA設(shè)計(jì)方案

      DFC設(shè)計(jì)公司是一家傳統(tǒng)的電子設(shè)計(jì)服務(wù)公司，其產(chǎn)品主要涉及基于FPGA和DSP技術(shù)的高端電子硬件及PCB設(shè)計(jì)、專用電子產(chǎn)品設(shè)計(jì)、機(jī)器視覺設(shè)計(jì)以及下面將會(huì)...

      2018-07-05 標(biāo)簽：fpga設(shè)計(jì)xilinx 4.6k 0

      手把手用Verilog實(shí)現(xiàn)FIR濾波器

      手把手用Verilog實(shí)現(xiàn)FIR濾波器

      首先需要把FIR最基本的結(jié)構(gòu)實(shí)現(xiàn)，也就是每個(gè)FIR抽頭的數(shù)據(jù)與其抽頭系數(shù)相乘這個(gè)操作。由頂層文件對(duì)這個(gè)基本模塊進(jìn)行多次調(diào)用。

      2023-06-19 標(biāo)簽：轉(zhuǎn)換器FPGA設(shè)計(jì)FIR 4.5k 0

      vivado主界面及設(shè)計(jì)流程

      vivado主界面及設(shè)計(jì)流程

      Vivado設(shè)計(jì)主界面，它的左邊是設(shè)計(jì)流程導(dǎo)航窗口，是按照FPGA的設(shè)計(jì)流程設(shè)置的，只要按照導(dǎo)航窗口一項(xiàng)一項(xiàng)往下進(jìn)行，就會(huì)完成從設(shè)計(jì)輸入到最后下載到開發(fā)...

      2023-09-17 標(biāo)簽：FPGA設(shè)計(jì)寄存器TCL 4.4k 0

      always組合邏輯塊的講解和譯碼器的實(shí)現(xiàn)

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      always 語句是重復(fù)執(zhí)行的。always 語句塊從 0 時(shí)刻開始執(zhí)行其中的行為語句；當(dāng)執(zhí)行完最后一條語句后，便再次執(zhí)行語句塊中的第一條語句，如此循環(huán)反復(fù)。

      2023-05-22 標(biāo)簽：FPGA設(shè)計(jì)led燈譯碼器 4.3k 0

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      今天我們將詳細(xì)說明可根據(jù)系統(tǒng)所要求的復(fù)雜程度來實(shí)現(xiàn)的電源排序解決方案。

      2019-06-25 標(biāo)簽：電源FPGA設(shè)計(jì) 4.3k 0

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      單端邏輯電平的匹配是我們平時(shí)在硬件設(shè)計(jì)中最經(jīng)常碰到的，我們?cè)凇禩TL&CMOS電平》章節(jié)中已經(jīng)對(duì)TTL和COMS電平的匹配設(shè)計(jì)做了一些分析，一般...

      2023-06-25 標(biāo)簽：二極管FPGA設(shè)計(jì)MOS管 4.3k 0

      Zynq高速串行CMOS接口的設(shè)計(jì)與實(shí)現(xiàn)

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      現(xiàn)在CMOS傳感器的分辨率越來越大，對(duì)應(yīng)的，對(duì)數(shù)據(jù)傳輸接口的要求也越來越高。

      2023-06-28 標(biāo)簽：轉(zhuǎn)換器FPGA設(shè)計(jì)寄存器 4.2k 0

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      2024-01-25 標(biāo)簽：FPGA設(shè)計(jì)PLL電路 4.2k 0

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      目前已經(jīng)學(xué)完了基礎(chǔ)實(shí)驗(yàn)，這里要介紹Quatus自帶的兩個(gè)非常重要的功能，第一個(gè)是tcl腳本，第二個(gè)是SignalTap（下一篇）。

      2023-09-07 標(biāo)簽：fpgaFPGA設(shè)計(jì)TCL 4.2k 0

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      時(shí)序邏輯電路的特點(diǎn)是輸出信號(hào)不僅與電路的輸入有關(guān)，還與電路原來的狀態(tài)有關(guān)。

      2023-09-17 標(biāo)簽：FPGA設(shè)計(jì)反相器D觸發(fā)器 4.1k 0

      Xilinx FPGA AXI4總線（二）用實(shí)例介紹5個(gè)讀寫通道

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      AXI4協(xié)議是一個(gè)點(diǎn)對(duì)點(diǎn)的主從接口協(xié)議，數(shù)據(jù)可以同時(shí)在主機(jī)（Master）和從機(jī)（Slave）之間**雙向** **傳輸** ，且數(shù)據(jù)傳輸大小可以不同。

      2023-06-21 標(biāo)簽：FPGA設(shè)計(jì)FIFO存儲(chǔ)BRAM 4.1k 0

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      在本文中，我們將簡(jiǎn)要介紹不同類型的濾波器，然后學(xué)習(xí)如何實(shí)現(xiàn)移動(dòng)平均濾波器并使用CIC架構(gòu)對(duì)其進(jìn)行優(yōu)化。

      2023-10-02 標(biāo)簽：FPGA設(shè)計(jì)低通濾波器加法器 4.1k 0

      基于FPGA設(shè)計(jì)的醫(yī)學(xué)監(jiān)測(cè)用視力測(cè)試儀設(shè)計(jì)

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      實(shí)現(xiàn)用FPGA隨機(jī)生成不同方向的E， 通過VGA接口在顯示器上顯示，判斷測(cè)試者按的按鍵方向是否正確，通過幾輪測(cè)試計(jì)算并顯示最終視力測(cè)試結(jié)果的功能

      2017-08-11 標(biāo)簽：fpgaFPGA設(shè)計(jì)視力測(cè)試儀 4.1k 2

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      2020-10-14 標(biāo)簽：FPGA設(shè)計(jì)XilinxC++ 4k 0

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      2020-04-21 標(biāo)簽：fpgaFPGA設(shè)計(jì)寄存器 3.9k 0

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      2023-09-06 標(biāo)簽：fpga模塊FPGA設(shè)計(jì) 3.9k 0

      FPGA專家教您如何在FPGA設(shè)計(jì)中使用HLS

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      Luke Miller并非一開始就是HLS（高層次綜合）的倡導(dǎo)者。在使用早期的工具版本的時(shí)候，他似乎有過一些糟糕的經(jīng)歷。

      2017-02-10 標(biāo)簽：FPGAFPGA設(shè)計(jì)HLS 3.9k 0

      淺析FPGA的調(diào)試-內(nèi)嵌邏輯分析儀(SignalTap)原理及實(shí)例

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      對(duì)于FPGA調(diào)試，主要以Intel FPGA為例，在win10 Quartus ii 17.0環(huán)境下進(jìn)行仿真和調(diào)試，開發(fā)板類型EP4CE15F17。

      2024-01-12 標(biāo)簽：FPGA設(shè)計(jì)寄存器狀態(tài)機(jī) 3.8k 0

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        Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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        QUARTUS II
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        +關(guān)注
        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
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        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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        +關(guān)注
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