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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級(jí)集成電路、軟件設(shè)計(jì)工具以及作為預(yù)定義系統(tǒng)級(jí)功能的IP(Intellectual Property)核。
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如果升級(jí)過程中出現(xiàn)意外情況,F(xiàn)LASH里面原有的固件被破壞,那么FPGA能夠從備份固件區(qū)啟動(dòng)配置,即FLASH里要有另外一份沒有問題的固件備份,且FPG...
fpga開發(fā)板能做什么?fpga開發(fā)板哪個(gè)好?
FPGA(現(xiàn)場(chǎng)可編程門陣列)和PLC(可編程邏輯控制器)在多個(gè)方面存在顯著的區(qū)別。
FPGA是在PAL、PLA和CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展起來的一種更復(fù)雜的可編程邏輯器件。它是ASIC領(lǐng)域中的一種半定制電路,既解決了定制電路...
 
														以MicroBlaze 處理器為內(nèi)核的嵌入式系統(tǒng)開發(fā)過程詳解
當(dāng)今時(shí)代,嵌入式系統(tǒng)已經(jīng)無所不在,與人們的日常生活息息相關(guān)。嵌入式系統(tǒng)以微處理器為核心,以計(jì)算機(jī)技術(shù)為基礎(chǔ),其主要特征是實(shí)時(shí)性強(qiáng)。據(jù)統(tǒng)計(jì),目前世界上微...
 
														基于Xilinx的A7系列FPGA的CAN總線協(xié)議開發(fā)
一、CAN總線協(xié)議介紹 CAN是 Controller Area Network 的縮寫(以下稱為 CAN ),是 ISO 國際標(biāo)準(zhǔn)化的串行通信協(xié)議???..
基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu)
本文設(shè)計(jì)一種基于FPGA的機(jī)載顯示系統(tǒng)架構(gòu),能夠?qū)崿F(xiàn)2D圖形繪制,構(gòu)成各種飛行參數(shù)畫面,同時(shí)疊加外景視頻圖像。BRAM資源占用方面,視頻旋轉(zhuǎn)算法需要27...
Xilinx FPGA帶你走進(jìn)8K視覺時(shí)代
視頻圖像系統(tǒng)正在朝更多像素、更高分辨率和更豐富色彩的方向飛速演變,4K視頻系統(tǒng)尚未大規(guī)模普及,8K視覺就已悄然而至。此前,Image Matter、i...
 
														基于DS89C450的Xilinx PROM在系統(tǒng)編程設(shè)計(jì)
基于查找表技術(shù)的FPGA在應(yīng)用時(shí)需要外置一個(gè)非易失性存儲(chǔ)器來存儲(chǔ)配置數(shù)據(jù)。如何方便靈活地對(duì)一個(gè)系統(tǒng)中多片F(xiàn)PGA的配置數(shù)據(jù)進(jìn)行升級(jí)是本文討論的問題
 
														
							FPGA設(shè)計(jì)中的信號(hào)連接到ILA核的時(shí)鐘和探針輸入如圖1。這些信號(hào)附加到探針輸入,以設(shè)計(jì)速度采樣,并使用片上塊RAM(BRAM)存儲(chǔ)。核參數(shù)指定探針的數(shù)...
 
														RAM-Based Shift Register Xilinx IP核的使用
一般來講,如果要實(shí)現(xiàn)移位寄存器的話,通常都是寫RTL用reg來構(gòu)造,比如1bit變量移位一個(gè)時(shí)鐘周期就用1個(gè)reg,也就是一個(gè)寄存器FF資源,而移位16...
 
														基于Xilinx公司硬IP核的方法實(shí)現(xiàn)PCI Express總線接口及數(shù)據(jù)的傳輸設(shè)計(jì)
現(xiàn)代測(cè)控系統(tǒng)和通信領(lǐng)域?qū)?shù)據(jù)傳輸速率的要求越來越高。相比PC 中其他技術(shù)的發(fā)展,總線技術(shù)的發(fā)展顯得相對(duì)緩慢,總線性能已經(jīng)成為制約系統(tǒng)性能發(fā)揮的瓶頸。傳...
在系統(tǒng)同步接口中,同一個(gè)系統(tǒng)時(shí)鐘既傳輸數(shù)據(jù)也獲取數(shù)據(jù)??紤]到板子路徑延時(shí)和時(shí)鐘抖動(dòng),接口的操作頻率不能太高。
 
														基于Xilinx ISE結(jié)合MATLAB對(duì)數(shù)字系統(tǒng)進(jìn)行聯(lián)合設(shè)計(jì)與仿真的方法設(shè)計(jì)詳解
聯(lián)合設(shè)計(jì)與仿真的方法針對(duì)數(shù)字信號(hào)處理FPGA設(shè)計(jì)實(shí)現(xiàn)中碰到的問題和困難,提出了有效可行的解決方法,大大提高了數(shù)字信號(hào)處理算法FPGA設(shè)計(jì)實(shí)現(xiàn)的效率,有...
 
														
							Vivado是一個(gè)非常強(qiáng)大的工具,但是在一些方面可能不能完全滿足我們的需求,比如代碼編輯器的功能。幸運(yùn)的是,Vivado允許我們關(guān)聯(lián)第三方編輯器來擴(kuò)展其...
WP_491將浮點(diǎn)轉(zhuǎn)為定點(diǎn),大幅降低功耗和成本
賽靈思器件和工具支持從二進(jìn)制到雙精度在內(nèi)的多種數(shù)據(jù)類型。UltraScale 架構(gòu)的可擴(kuò)展精度提供極大靈活性,便于優(yōu)化功耗和資源利用,同時(shí)滿足設(shè)計(jì)性能目標(biāo)要求。
2017-09-21 標(biāo)簽:Xilinx 2.7k 0
 
														FPGA實(shí)現(xiàn)的“俄羅斯方塊”游戲系統(tǒng)設(shè)計(jì)
本項(xiàng)目主要在FPGA上實(shí)現(xiàn)了一個(gè)經(jīng)典小游戲“俄羅斯方塊”。本項(xiàng)目基本解決方案是,使用Xilinx Zynq系列開發(fā)板 ZedBoard 作為平臺(tái),實(shí)現(xiàn)主...
 
														Xilinx SDNet開發(fā)環(huán)境支持最新的P4開發(fā)語言規(guī)范
軟件定義網(wǎng)絡(luò)(Software Defined Network,SDN ),是由美國斯坦福大學(xué)研究項(xiàng)目組提出的一種新型網(wǎng)絡(luò)創(chuàng)新架構(gòu),其核心技術(shù)OpenF...
2018-07-05 標(biāo)簽:xilinx開發(fā)環(huán)境 2.7k 0
Vivado中對(duì)RTL源文件如何進(jìn)行加密
直接把密鑰嵌入到RTL源文件中 允許客戶直接把密鑰的內(nèi)容直接貼到RTL源文件中protect begin和protect end之間的內(nèi)容就是用戶原始R...
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