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芯片設(shè)計

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《芯片設(shè)計》是2009年11月上海科學(xué)技術(shù)出版社出版的圖書，作者是（德）B.科爾特，（德）J.菲根。

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芯片設(shè)計技術(shù)

硅光是以光子和電子為信息載體的硅基電子大規(guī)模集成技術(shù)，能夠突破傳統(tǒng)電子芯片的極限性能，是5G通信、大數(shù)據(jù)、人工智能、物聯(lián)網(wǎng)等新型產(chǎn)業(yè)的基礎(chǔ)支撐。光纖到硅...

2023-08-15 標(biāo)簽：耦合芯片設(shè)計診斷儀 1.6k 0

到底誰能提升Calibre的效率？

Siemens的Calibre是業(yè)內(nèi)權(quán)威的版圖驗證軟件，被各大Foundry廠廣泛認(rèn)可。用戶可以直接在Virtuoso界面集成Calibre接口，調(diào)用版...

2023-07-25 標(biāo)簽：芯片設(shè)計仿真器 SWAP 1.6k 0

芯片設(shè)計問題須知及設(shè)計策略

　　長期可靠性的問題，比如電子遷移（EM）失效機制，歷來屬于晶圓廠的處理范疇。但隨著納米設(shè)計中可靠性實現(xiàn)的愈加困難，對設(shè)計人員而言，不能再把問題扔給制造...

2012-05-02 標(biāo)簽：芯片設(shè)計電子遷移可靠性 1.6k 0

晶圓清洗：芯片設(shè)計與生產(chǎn)中的關(guān)鍵一環(huán)

蒸汽脫脂工藝一旦建立并經(jīng)過測試，就會保持恒定，并且可以實現(xiàn)自動化以提高效率。清潔結(jié)果保持可重復(fù)且一致。

2024-03-21 標(biāo)簽：晶圓芯片設(shè)計 1.6k 0

聊聊芯片設(shè)計有哪些活要做？

芯片設(shè)計這個行當(dāng)，從大的方面講，主要分模擬和數(shù)字兩大塊，而每大塊又分前端和后端，我想大部分同學(xué)對這個肯定是非常清楚的，下面就數(shù)字電路聊聊芯片設(shè)計的一些事...

2023-11-25 標(biāo)簽：寄存器芯片設(shè)計 RTL 1.6k 0

詳解芯片制造中的可測性設(shè)計

然而，隨著納米技術(shù)的出現(xiàn)，芯片制造過程越來越復(fù)雜，晶體管密度增加，導(dǎo)致導(dǎo)線短路或斷路的概率增大，芯片失效可能性大大提升。測試費用可達(dá)到制造成本的50%以上。

2025-10-16 標(biāo)簽：芯片設(shè)計可測性設(shè)計 DFT設(shè)計 1.6k 0

機器學(xué)習(xí)如何影響計算機硬件設(shè)計3

為什么芯片設(shè)計需要很長時間？能不能加速芯片設(shè)計周期？能否在幾天或幾周之內(nèi)完成芯片的設(shè)計？這是一個非常有野心的目標(biāo)。過去十年，機器學(xué)習(xí)的發(fā)展離不開系統(tǒng)和硬...

2023-02-20 標(biāo)簽：計算機芯片設(shè)計硬件設(shè)計 1.6k 0

PCIe 6.0的優(yōu)化設(shè)計方案探討分析

為了實現(xiàn)64GT/s的鏈路速度，PCIe 6.0采用脈沖幅度調(diào)制4級 (PAM4) 信號，在與32GT/s PCIe相同的單元間隔(UI)中提供4個幅度...

2023-08-05 標(biāo)簽：soc 芯片設(shè)計 SSD 1.6k 0

設(shè)計開發(fā)開關(guān)電源DC－DC控制芯片需要注意的幾點

電流型控制是指將誤差放大器輸出信號與采樣到的電感峰值電流進(jìn)行比較。從而對輸出脈沖的占空比進(jìn)行控制，使輸出的電感峰值電流隨誤差電壓變化而變化。

2020-05-01 標(biāo)簽：芯片設(shè)計開關(guān)器件 DC－DC變換器 1.6k 0

芯片設(shè)計的核心技術(shù)與關(guān)鍵優(yōu)勢概述

應(yīng)對網(wǎng)絡(luò)威脅正在成為芯片和系統(tǒng)設(shè)計的一個組成部分，并且更加昂貴和復(fù)雜。

2023-12-11 標(biāo)簽：soc 芯片設(shè)計 OTA 1.5k 0

產(chǎn)生高質(zhì)量芯片：熱設(shè)計注意事項須知

　　當(dāng)所設(shè)計的芯片需要滿足經(jīng)常不一致的規(guī)格要求時，先進(jìn)的工藝和設(shè)計技術(shù)也會帶來艱巨的挑戰(zhàn)。在納米級設(shè)計中，功耗已經(jīng)成為限制性能的主要因素。納米工藝中使用...

2012-05-03 標(biāo)簽：芯片設(shè)計熱設(shè)計 1.5k 0

軟硬件協(xié)同仿真原理及主要組成部分概述

軟硬件聯(lián)合仿真在確保高效云解決方案的質(zhì)量、降低風(fēng)險、節(jié)省時間和成本方面發(fā)揮著關(guān)鍵作用。

2023-10-16 標(biāo)簽：芯片設(shè)計 RTL TLM 1.5k 0

芯片Block的劃分問題解析

后端在floorplan階段，如何擺放macro是一個很重要的問題。如果采用層次化設(shè)計，對于每一個block來說都需要在block內(nèi)部把所分配的macro擺好。

2023-12-06 標(biāo)簽：芯片設(shè)計 STD 機器學(xué)習(xí) 1.5k 0

機器學(xué)習(xí)如何影響計算機硬件設(shè)計2

2023-02-20 標(biāo)簽：Google 芯片設(shè)計硬件設(shè)計 1.5k 0

直接在網(wǎng)表中插入RTL來快速做芯片功能ECO

近幾年，芯片設(shè)計規(guī)模越來越大，這使得重跑一次綜合需要長達(dá)數(shù)小時，甚至幾天時間。

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異步電路不能根據(jù)時鐘是否同源來界定，時鐘之間沒有確定的相位關(guān)系是唯一準(zhǔn)則。

2023-06-27 標(biāo)簽：FPGA設(shè)計芯片設(shè)計異步電路 1.5k 0

聊聊例化寄存器型的RTL編碼設(shè)計

邏輯和互聯(lián)更加清晰，更接近于底層電路實現(xiàn)對工具友好。同時我的習(xí)慣是用xx_d、xx_q、xx_en來命名信號，那么在寫邏輯時，代碼中用到了xx_q我就會...

2023-11-10 標(biāo)簽：寄存器芯片設(shè)計 RTL 1.5k 0

機器學(xué)習(xí)如何影響計算機硬件設(shè)計1

2023-02-20 標(biāo)簽：Google 芯片設(shè)計硬件設(shè)計 1.5k 0

芯片設(shè)計全流程概述

使用硬件描述語言（VHDL，Verilog HDL，業(yè)界公司一般都是使用后者）將模塊功能以代碼來描述實現(xiàn)，也就是將實際的硬件電路功能通過HDL語言描述出...

2023-07-09 標(biāo)簽：機器人芯片設(shè)計仿真 1.5k 0

如何選擇最佳數(shù)字IP

在選擇數(shù)字IP時，客戶的要求是否可以更大膽一些？答案是肯定的。SoC設(shè)計人員當(dāng)然非常希望能夠比較數(shù)字IP的PPA。然而這在很大程度上是不可能的，因為可用...

2023-09-15 標(biāo)簽：處理器 soc 芯片設(shè)計 1.4k 0

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